[实用新型]全站型电子速测仪测距逻辑控制芯片电路无效

专利信息
申请号: 201020630987.2 申请日: 2010-11-29
公开(公告)号: CN202033027U 公开(公告)日: 2011-11-09
发明(设计)人: 杨岚;李思广 申请(专利权)人: 天津欧波精密仪器股份有限公司
主分类号: G01C3/02 分类号: G01C3/02
代理公司: 天津市杰盈专利代理有限公司 12207 代理人: 赵庆
地址: 300457 *** 国省代码: 天津;12
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摘要: 全站型电子速测仪测距逻辑控制芯片电路,其特征在于:主要包括测距逻辑控制芯片LC4064,以及与之连接的器件:管脚36为逻辑控制芯片复位信号线与复位芯片MAX809T连接;管脚31、30为发射管控制信号与发射二极管MF228由逻辑芯片连接,控制发射管发射红外光,管脚23、10、1、32为JTAG口调试信号线,管脚2、3、4、7、8、9、13、14、15、16、44与CPU通信的信号线与中央处理器连接,管脚39、17为CPLD时钟信号线,管脚19为CPLD的混频输出信号,管脚28、6、33、11、34、12、5、27为电源。减少了生产成本和加工成本,提高了电路的稳定性和处理速度,减少了功耗,延长了电池使用时间。
搜索关键词: 全站型 电子 速测仪 测距 逻辑 控制 芯片 电路
【主权项】:
全站型电子速测仪测距逻辑控制芯片电路,其特征在于:主要包括测距逻辑控制芯片LC4064,以及与之连接的器件:管脚36为逻辑控制芯片复位信号线与复位芯片MAX809T连接,为逻辑控制芯片提供复位信号;管脚31、30为发射管控制信号与发射二极管MF228由逻辑芯片连接,控制发射管发射红外光;管脚23、10、1、32为JTAG口调试信号线,用于下载程序,调试逻辑控制芯片工作状态;管脚2、3、4、7、8、9、13、14、15、16、44为与CPU通信的信号线与中央处理器连接,用于逻辑控制芯片和数据交换;管脚39、17为CPLD时钟信号线,与时钟信号连接为逻辑控制芯片提供的时钟信号;管脚19为CPLD的混频输出信号,测距混频信号为测距接收处理电路提供混频信号;管脚28、6、33、11、34、12、5、27为电源,为逻辑控制芯片供电。
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