[实用新型]基于低成本多路并行高速率的A/D采样电路板有效
| 申请号： | 201020667501.2 | 申请日： | 2010-12-20 |
| 公开（公告）号： | CN202019349U | 公开（公告）日： | 2011-10-26 |
| 发明（设计）人： | 王伟权 | 申请（专利权）人： | 四川九洲电器集团有限责任公司 |
| 主分类号： | H03M1/54 | 分类号： | H03M1/54 |
| 代理公司： | 成都九鼎天元知识产权代理有限公司 51214 | 代理人： | 徐宏;吴彦峰 |
| 地址： | 621000 四*** | 国省代码： | 四川;51 |
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| 摘要： | 本实用新型公布了一种基于低成本多路并行高速率的A/D采样电路，包括模拟信号输入模块、时钟产生和分配模块、并行ADC模块、FPGA模块和DSP模块。模拟信号输入模块主要实现对模拟信号的输入，时钟产生和分配模块主要为并行ADC模块提供统一时钟基准。该实用新型主要以较低成本实现高速A/D采样。一方面降低硬件开发成本，另一方面更接近目前软件无线电的开发理念。 | ||
| 搜索关键词： | 基于 低成本 并行 速率 采样 电路板 | ||
【主权项】：
一种基于低成本多路并行高速率的A/D采样电路板，其特征是：该电路板包括模拟信号输入电路、时钟产生和分配模块、ADC模块、FPGA模块和DSP模块；所述模拟信号处理模块主要实现对模拟信号的输入，以驱动ADC模块；时钟产生和分配模块为ADC模块提供同一时钟基准；FPGA模块和DSP模块用于将经过高速采样处理后形成的数字信号进行采样校正和验证效果。
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