[实用新型]一种采样时钟控制电路有效
| 申请号： | 201020694058.8 | 申请日： | 2010-12-30 |
| 公开（公告）号： | CN201937574U | 公开（公告）日： | 2011-08-17 |
| 发明（设计）人： | 徐栋;杨思彦;陈富涛;严淼;彭云武 | 申请（专利权）人： | 无锡华润矽科微电子有限公司 |
| 主分类号： | H03M1/54 | 分类号： | H03M1/54 |
| 代理公司： | 上海智信专利代理有限公司 31002 | 代理人： | 王洁 |
| 地址： | 214061*** | 国省代码： | 江苏;32 |
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| 摘要： | 本实用新型公开一种采样时钟控制电路，包括第一PMOS管、第二PMOS管、第一NMOS管、延时模块、基准模块、第一反相器、与非门，其中第一PMOS管漏接信号输入、栅接第一时钟信号、源接信号输出、衬底接电源，第二PMOS管漏接第二时钟信号、栅接第一内部连线、源接基准电压、衬底接电源；第一NMOS管漏接信号输入、栅接第二时钟信号、源接信号输出、衬底接地；延时模块输入端接第一时钟信号，输出端接第一延时时钟信号；第一反相器的输入端接第一时钟信号，输出端接第二内部连线；与非门的两个输入端分别接第二内部连线和第一延时时钟信号，输出端接第一内部连线；电容两端分别接到第一延时时钟信号、第二时钟信号；基准模块接到基准电压。 | ||
| 搜索关键词： | 一种 采样 时钟 控制电路 | ||
【主权项】：
一种采样时钟控制电路，包括第一PMOS管、第二PMOS管、第一NMOS管、延时模块、基准模块、第一反相器、与非门，其特征在于：第一PMOS管漏接信号输入、栅接第一时钟信号、源接信号输出、衬底接电源，第二PMOS管漏接第二时钟信号、栅接第一内部连线、源接基准电压、衬底接电源；第一NMOS管漏接信号输入、栅接第二时钟信号、源接信号输出、衬底接地；延时模块输入端接第一时钟信号，输出端接第一延时时钟信号；第一反相器的输入端接第一时钟信号，输出端接第二内部连线；与非门的两个输入端分别接第二内部连线和第一延时时钟信号，输出端接第一内部连线；电容两端分别接到第一延时时钟信号、第二时钟信号；基准模块接到基准电压。
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