[发明专利]包括FIFO存储器的接口连接电路有效
| 申请号： | 201080033439.4 | 申请日： | 2010-07-20 |
| 公开（公告）号： | CN102576301A | 公开（公告）日： | 2012-07-11 |
| 发明（设计）人： | 埃里克·切拉托;莱昂内尔·赛纳格雷 | 申请（专利权）人： | 意法爱立信有限公司 |
| 主分类号： | G06F5/06 | 分类号： | G06F5/06 |
| 代理公司： | 北京同达信恒知识产权代理有限公司 11291 | 代理人： | 黄志华 |
| 地址： | 瑞士普*** | 国省代码： | 瑞士;CH |
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| 摘要： | 一种包括用于在“数据产生者装置”和“数据消费者装置”之间交换数据的先入先出(FIFO)存储器的接口连接电路。所述FIFO存储器由第一写控制信号(WR，CLK_WR)和第二读控制信号(ENABLE，Clk_Rd)控制。所述接口连接电路还包括：冗余过滤器(230)，所述冗余过滤器用于接收待存储在FIFO内的N个数据(Y0，Y1，Y2....Yn-1)的序列，且用于产生冗余控制字，所述冗余控制字表示在所述序列中连续的相等数据的出现；装置(250)，所述装置(250)用于控制所述FIFO的所述第一和所述第二控制信号，以避免多个连续的相等数据存储到所述FIFO，且更重要的是由于冗余过滤导致传输效率增加，可能加速进入“数据消费者装置”的数据流量的平均速度，而无需加速供给所述FIFO的存储器时钟。 | ||
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【主权项】：
一种接口连接电路，包括先入先出(FIFO)存储器，所述FIFO存储器用于在第一系统(数据产生者)和第二系统(数据消费者)之间交换数据，所述FIFO存储器由第一写控制信号(WR、CLK_WR)和第二读控制信号(ENABLE、Clk_Rd)控制，其特征在于，所述接口连接电路还包括：‑冗余过滤器(230)，所述冗余过滤器(230)用于接收待存储在所述FIFO内的N个数据(Y0、Y1、Y2....Yn‑1)的序列，且用于产生冗余控制字，所述冗余控制字表示在所述序列中连续的相同数据的出现，所述连续的相同数据相隔的距离低于预定阈值；‑用于控制所述FIFO的所述第一写控制信号和所述第二读控制信号以防止多个连续的相同数据存储到所述FIFO的装置(250)。
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