[发明专利]4输入查找表、FPGA逻辑单元和FPGA逻辑块无效

专利信息
申请号: 201110046775.9 申请日: 2011-02-25
公开(公告)号: CN102176673A 公开(公告)日: 2011-09-07
发明(设计)人: 韩小炜;陈陵都 申请(专利权)人: 中国科学院半导体研究所
主分类号: H03K19/177 分类号: H03K19/177;G11C11/409
代理公司: 中科专利商标代理有限责任公司 11021 代理人: 周国城
地址: 100083 *** 国省代码: 北京;11
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摘要: 发明公开了一种LUT4、FPGA逻辑单元和FPGA逻辑块。该4输入查找表LUT4包括:两个3输入查找表LUT3和四个2选1多路复用器,该两个LUT3为C-LUT3和S-LUT3,该四个2选1多路复用器为FMUX,CMUX,SMUX和F4MUX;数据输入端口A0,A1,以及A2(0)经过CMUX选择后的输出分别进入C-LUT3的三个输入端口;数据输入端口A0,A1(0)与A3(1)经过SMUX选择后的输出,以及A2(0)经过CMUX选择后的输出分别进入S-LUT3的三个输入端口;数据输入端口A3(1)与逻辑‘0’经过FMUX选择后的输出进入F4MUX的控制端口,S-LUT3的输出(0)经过F4MUX选择后从该LUT4的输出端口F4输出;FPGA逻辑单元中,Fmux,Smux和Cmux分别为FMUX,SMUX和CMUX的控制位。本发明的LUT4、FPGA逻辑单元和FPGA逻辑块能够提高逻辑密度。
搜索关键词: 输入 查找 fpga 逻辑 单元
【主权项】:
一种4输入查找表LUT4,其特征在于,该LUT4包括:两个3输入查找表LUT3和四个2选1多路复用器,该两个LUT3为C‑LUT3和S‑LUT3,该四个2选1多路复用器为FMUX,CMUX,SMUX和F4MUX;数据输入端口A0,A1,以及A2(0)经过CMUX选择后的输出分别进入C‑LUT3的三个输入端口;数据输入端口A0,A1(0)与A3(1)经过SMUX选择后的输出,以及A2(0)经过CMUX选择后的输出分别进入S‑LUT3的三个输入端口;数据输入端口A3(1)与逻辑‘0’经过FMUX选择后的输出进入F4MUX的控制端口,S‑LUT3的输出(0)经过F4MUX选择后从该LUT4的输出端口F4输出;所述LUT4中,Fmux,Smux和Cmux分别为所述FMUX,SMUX和CMUX的控制位。
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