[发明专利]交织多址系统中的一种迭代定时同步电路及方法无效
| 申请号： | 201110175020.9 | 申请日： | 2011-06-27 |
| 公开（公告）号： | CN102201894A | 公开（公告）日： | 2011-09-28 |
| 发明（设计）人： | 熊兴中;胡剑浩;王钊 | 申请（专利权）人： | 电子科技大学 |
| 主分类号： | H04L1/00 | 分类号： | H04L1/00;H04L25/02;H04W56/00 |
| 代理公司： | 四川力久律师事务所 51221 | 代理人： | 林辉轮;王芸 |
| 地址： | 四川省成都市高*** | 国省代码： | 四川;51 |
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| 摘要： | 本发明公开了一种交织多址系统(IDMA)中的一种迭代定时同步电路及方法，方法步骤为：步骤一、由IDMA系统的基站端利用其迭代检测过程中的信噪比-方差演进技术对不同用户的时偏进行估计；步骤二、将各个用户的时偏信息反馈到相应用户的发送端；步骤三、由用户端进行时偏补偿的迭代定时同步方法，实现IDMA系统的迭代定时同步功能。本发明解决IDMA上行链路通信系统中的定时同步瓶颈问题。本发明主要适用于IDMA系统上行链路中的定时同步。 | ||
| 搜索关键词： | 交织 系统 中的 一种 定时 同步 电路 方法 | ||
【主权项】：
一种交织多址系统中的一种迭代定时同步电路，其特征在于：译码器(1～K)将信号传输给时偏估计器，时偏估计器再将信号输入到时偏控制比特产生器，时偏控制比特产生器将信号通过下行链路传输。
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