[发明专利]一种三维存储器阵列结构及其制造方法有效
申请号: | 201110298260.8 | 申请日: | 2011-09-29 |
公开(公告)号: | CN102306655A | 公开(公告)日: | 2012-01-04 |
发明(设计)人: | 潘立阳;袁方 | 申请(专利权)人: | 清华大学 |
主分类号: | H01L27/24 | 分类号: | H01L27/24;H01L45/00 |
代理公司: | 北京清亦华知识产权代理事务所(普通合伙) 11201 | 代理人: | 张大威 |
地址: | 100084 北京*** | 国省代码: | 北京;11 |
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摘要: | 本发明提供一种三维存储器阵列结构及其制造方法,该三维存储器阵列由基于相互串联的栅控PNPN垂直选择管和阻变或相变单元的存储单元在三维空间衍生形成。通过具有高开关电流比的存储单元,有效改善存储阵列操作时的相邻单元之间的串扰和漏电问题,并且简化存储单元结构,实现多层堆叠,提高存储密度。 | ||
搜索关键词: | 一种 三维 存储器 阵列 结构 及其 制造 方法 | ||
【主权项】:
一种三维存储器阵列结构,其特征在于,包括:叠置形成的多个阵列层,每个所述阵列层包括多列存储单元,其中,所述存储单元包括相互串联的垂直选择管和相变单元或阻变单元,其中,所述垂直选择管包括:上电极;下电极;以及形成在所述上电极和下电极之间的半导体体区,其中,所述半导体体区包括依次垂直堆叠的第一半导体层、第二半导体层、第三半导体层和第四半导体层,其中,所述第一半导体层和所述第三半导体层为第一类型掺杂,所述第二半导体层和所述第四半导体层为第二类型掺杂,在所述第三半导体层的一个侧面形成有栅堆叠,且所述第三半导体层的掺杂浓度低于所述第二半导体层和第四半导体层的掺杂浓度,以使所述第二半导体层、第三半导体层、第四半导体层和所述栅堆叠形成垂直的MOS晶体管,所述第一半导体层和第二半导体层形成垂直的二极管,且,同一所述阵列层上的两列相邻所述存储单元之间共用一个栅堆叠。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的
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