[发明专利]在分体模块间进行AXI总线信号发送接收的方法及装置有效
| 申请号： | 201110302764.2 | 申请日： | 2011-10-09 |
| 公开（公告）号： | CN103034610B | 公开（公告）日： | 2018-09-04 |
| 发明（设计）人： | 李虎虎;杜睿;王峰;唐雄;万振华 | 申请（专利权）人： | 南京中兴软件有限责任公司 |
| 主分类号： | G06F13/42 | 分类号： | G06F13/42 |
| 代理公司： | 北京安信方达知识产权代理有限公司 11262 | 代理人： | 解婷婷;龙洪 |
| 地址： | 210012 江苏省南*** | 国省代码： | 江苏;32 |
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| 摘要： | 一种在分体模块间进行AXI总线信号传输的方法及装置，所述发送方法包括：发送方模块通过AXI总线将待发送数据写入兵乓随机存取存储器(RAM)中；其中，写入速率为clk0，通过AXI总线写入的数据位宽为N；帧格式转换单元从乒乓RAM中读取数据，并将在预设时长内读出的数据及同步字K28.5写入到一宽为M比特的帧格式后，发送给第一串行器/解串器(SERDES)；其中，M为第一SERDES的并行输入数据位宽值；第一SERDES对该帧格式中的所有比特数据进行编码、并串转换及数模转换处理后，以串行的方式发送给接收方模块。本发明解决了分体模块之间进行数据传输时AXI总线的成本高、延迟大、性能低的问题。 | ||
| 搜索关键词： | 分体 模块 进行 axi 总线 信号 发送 接收 方法 装置 | ||
【主权项】：
1.一种在分体模块间进行高级可扩展接口AXI总线信号发送的方法，包括：发送方模块通过AXI总线将待发送数据写入乒乓随机存取存储器RAM中；其中，写入速率为clk0，通过AXI总线写入的数据位宽为N；帧格式转换单元从所述乒乓RAM中读取数据，并将在一预设时长内读出的数据及同步字K28.5写入到一宽为M比特的帧格式后，发送给第一串行器/解串器SERDES；其中，M为所述第一SERDES的并行输入数据位宽值；所述第一SERDES对所述帧格式中的所有比特数据进行编码、并串转换及数模转换处理后，将得到的数据以串行的方式发送给接收方模块。
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