[发明专利]一种MVB网络的数据检测设备及方法无效
申请号: | 201110363439.7 | 申请日: | 2011-11-16 |
公开(公告)号: | CN102497290A | 公开(公告)日: | 2012-06-13 |
发明(设计)人: | 王立德;严翔;宋娟 | 申请(专利权)人: | 北京交通大学 |
主分类号: | H04L12/26 | 分类号: | H04L12/26 |
代理公司: | 北京润泽恒知识产权代理有限公司 11319 | 代理人: | 苏培华 |
地址: | 100044 *** | 国省代码: | 北京;11 |
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摘要: | 本申请提供了一种MVB网络的数据检测设备及方法。所述的设备包括:FPGA控制器、USB控制器、USB总线接口和MVB物理接口。其中,FPGA控制器通过MVB物理接口连接MVB网络,捕获MVB网络传输的数据包并解码,若解码为完整数据,则将数据通过USB控制器传送到上位机;若解码为不完整的数据包,则通过FPGA控制器的错误分析模块进行处理,然后将错误信息通过USB控制器传送到上位机。本申请所述的设备能够通过FPGA控制器实现对MVB网络数据进行实时处理、分析,数据处理效率高,节省时间。并可以通过USB串口高速传送至上位机,无需采用CPU控制的数据传输模式,快速的上报错误信息和正确数据。 | ||
搜索关键词: | 一种 mvb 网络 数据 检测 设备 方法 | ||
【主权项】:
一种MVB网络的数据检测设备,其特征在于,包括:FPGA控制器、USB控制器、USB总线接口和MVB物理接口,其中,所述的FPGA控制器用于完成MVB协议控制及网络错误分析,包括MVB协议控制模块、错误分析模块和USB接口控制模块;所述的MVB协议控制模块通过内部总线连接错误分析模块和USB接口控制模块,包括MVB接口IP核子模块和内部存储器子模块;所述的错误分析模块通过内部总线,分别连接MVB协议控制模块和USB接口控制模块;USB接口控制模块封装了读写USB控制器的相关时序,通过内部总线分别连接MVB协议控制模块和错误分析模块。所述USB控制器包括FIFO模块和SIE模块,FIFO模块通过内部总线连接SIE模块;FPGA控制器的MVB协议控制模块通过MVB物理接口连接MVB网络;FPGA控制器的USB接口控制模块连接USB控制器的FIFO模块;USB控制器的SIE模块通过USB总线接口连接上位机。
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