[实用新型]多CPU高速通讯装置有效
| 申请号： | 201120363340.2 | 申请日： | 2011-09-26 |
| 公开（公告）号： | CN202267964U | 公开（公告）日： | 2012-06-06 |
| 发明（设计）人： | 陈津;文刚;栾庆宏;刘海龙 | 申请（专利权）人： | 淄博康润电气有限公司 |
| 主分类号： | G06F15/163 | 分类号： | G06F15/163 |
| 代理公司： | 青岛发思特专利商标代理有限公司 37212 | 代理人： | 马俊荣 |
| 地址： | 255086 山东省淄博市*** | 国省代码： | 山东;37 |
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| 摘要： | 本实用新型涉及一种多CPU高速通讯装置。所述的多CPU高速通讯装置，包括主CPU和协同CPU，其特征在于：还包括多路复用器、SRAM和译码器，主CPU和协同CPU与SRAM的数据总线、地址总线、读信号/OE、写信号/WE分别相连，主CPU和协同CPU的片选信号/CE通过多路复用器分别于SRAM的片选信号/CE相连，协同CPU通过译码器连接主CPU的GPIO引脚的A、B、C。其结构简单、设计合理，主CPU和协同CPU通过SRAM进行数据交换，加大通讯的信息量，提高系统的执行速度，满足多CPU之间的数据通讯需要。 | ||
| 搜索关键词： | cpu 高速 通讯 装置 | ||
【主权项】：
一种多CPU高速通讯装置，包括主CPU和协同CPU，其特征在于：还包括多路复用器、SRAM和译码器，主CPU和协同CPU与SRAM的数据总线、地址总线、读信号/OE、写信号/WE分别相连，主CPU和协同CPU的片选信号/CE通过多路复用器分别于SRAM的片选信号/CE相连，协同CPU通过译码器连接主CPU的GPIO引脚的A、B、C。
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