[发明专利]时钟数据回复电路及方法无效

专利信息
申请号: 201210240396.8 申请日: 2012-07-11
公开(公告)号: CN103546403A 公开(公告)日: 2014-01-29
发明(设计)人: 许家豪;江昱兴 申请(专利权)人: 联咏科技股份有限公司
主分类号: H04L25/03 分类号: H04L25/03
代理公司: 北京市柳沈律师事务所 11105 代理人: 史新宏
地址: 中国台湾新竹*** 国省代码: 中国台湾;71
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摘要: 一种时钟数据回复电路,包括一均衡器、一多相位时钟产生器、一取样与检查单元、一信号边缘检测单元以及一调整单元。均衡器执行一进入数据信号的均衡。多相位时钟产生器产生多个时钟信号与至少一对检查信号。取样与检查单元依据此些时钟信号取样进入数据信号以得到一序列,并检查序列是否符合一特定型样。当序列符合特定型样时,信号边缘检测单元控制取样与检查单元基于至少此对检查信号两两对应检测序列的值的转换处以得到一检测值。调整单元依据检测值判断转换是太早或太晚,并依据判断的结果调整进入数据信号的均衡。
搜索关键词: 时钟 数据 回复 电路 方法
【主权项】:
一种时钟数据回复电路,包括:一均衡器,用以执行一进入数据信号的均衡;一多相位时钟产生器,用以产生多个时钟信号与至少一对检查信号;一取样与检查单元,用以依据该多个时钟信号取样该进入数据信号以得到一序列,并检查该序列是否符合一特定型样;一信号边缘检测单元,用以当该序列符合该特定型样时,控制该取样与检查单元基于至少该对检查信号两两对应检测该序列的值的转换处以得到一检测值;以及一调整单元,用以依据该检测值判断该序列的值的转换是太早或太晚,并依据判断的结果控制该均衡器以调整该进入数据信号的均衡。
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