[发明专利]半导体器件制造方法有效

专利信息
申请号: 201210393040.8 申请日: 2012-10-16
公开(公告)号: CN103730345B 公开(公告)日: 2018-02-13
发明(设计)人: 秦长亮;梁擎擎;殷华湘;毛淑娟 申请(专利权)人: 中国科学院微电子研究所
主分类号: H01L21/28 分类号: H01L21/28;H01L21/336
代理公司: 北京蓝智辉煌知识产权代理事务所(普通合伙)11345 代理人: 陈红
地址: 100029 *** 国省代码: 北京;11
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摘要: 发明提供了一种利用间隙壁技术形成栅极的晶体管的制造方法。在本发明的方法中,在第一材料层的侧面,依次形成第一间隙壁、第二间隙壁、第三间隙壁以及第四间隙壁,通过去除第二间隙壁形成了宽度由第二间隙壁控制的栅极凹槽,继而在栅极凹槽中形成所需要的栅极和栅极绝缘层。本发明中,利用回刻蚀形成间隙壁,不需要采用额外的掩模版,并且,通过控制第二间隙壁的宽度来限定栅极宽度,可以实现亚45nm的栅极线条的形成,并且使工艺具有良好的可控性。
搜索关键词: 半导体器件 制造 方法
【主权项】:
一种半导体器件制造方法,其特征在于包括如下步骤:提供半导体衬底,在该半导体衬底上形成STI结构,并进行阱区注入;形成图案化的第一材料层;全面性沉积第一间隙壁材料层,并进行回刻蚀,形成位于所述第一材料层侧面上的第一间隙壁;全面性沉积第二间隙壁材料层,并进行回刻蚀,形成位于所述第一间隙壁的侧面上的第二间隙壁;全面性沉积第三间隙壁材料层,并进行回刻蚀,形成位于所述第二间隙壁的侧面上的第三间隙壁;所述第一间隙壁、第二间隙壁、第三间隙壁形成复合间隙壁去除所述第一材料层;形成源漏区域;全面性沉积第二材料层,并进行CMP工艺,暴露出所述复合间隙壁;去除所述第二间隙壁,形成栅极空洞;依次沉积栅极绝缘材料层和栅极材料层,并进行CMP工艺,去除部分所述栅极材料层和所述栅极绝缘材料层,使得所述栅极材料层和所述栅极绝缘材料层仅位于所述栅极空洞之内,从而形成栅极和栅极绝缘层。
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