[发明专利]金属互连结构的制作方法有效
申请号: | 201210396195.7 | 申请日: | 2012-10-17 |
公开(公告)号: | CN102881648A | 公开(公告)日: | 2013-01-16 |
发明(设计)人: | 夏建慧;顾以理;奚裴 | 申请(专利权)人: | 上海宏力半导体制造有限公司 |
主分类号: | H01L21/768 | 分类号: | H01L21/768 |
代理公司: | 北京集佳知识产权代理有限公司 11227 | 代理人: | 骆苏华 |
地址: | 201203 上海市浦东新*** | 国省代码: | 上海;31 |
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摘要: | 一种金属互连结构的制作方法,包括:提供半导体衬底;在其上依次形成介质层、第一缓冲层、第一图案硬掩模层、第二缓冲层、第二图案硬掩模层,所述第一图案硬掩模层和第二图案硬掩模层为互相交叉的线条状图形;以第二图案硬掩模层和第一图案硬掩模层为掩模,刻蚀第二缓冲层和第一缓冲层至露出介质层,形成缓冲层图案;以所述缓冲层图案为掩模,刻蚀介质层至在第二图案硬掩模层下方的第二缓冲层消失后,第一图案硬掩模层下方的第一缓冲层消失前停止,以在所述介质层内形成多个通孔及连接至少两个通孔的沟槽;去除残留的第一缓冲层。本发明以所述缓冲层图案为掩模刻蚀介质层,可以在介质层中同时形成金属互连结构中的沟槽和通孔。 | ||
搜索关键词: | 金属 互连 结构 制作方法 | ||
【主权项】:
一种金属互连结构的制作方法,其特征在于,包括:提供半导体衬底;在所述半导体衬底上形成介质层;在所述介质层上形成第一缓冲层;在所述第一缓冲层上形成第一图案硬掩模层,所述第一图案硬掩模层具有多个线条状图形;在所述第一缓冲层和所述第一图案硬掩模层上形成第二缓冲层;在所述第二缓冲层上形成第二图案硬掩模层,所述第二图案硬掩模层具有多个线条状图形,所述第二图案硬掩模层的线条状图形和所述第一图案硬掩模层的线条状图形互相交叉;以所述第二图案硬掩模层和第一图案硬掩模层为掩模,刻蚀所述第二缓冲层和第一缓冲层至露出介质层,形成缓冲层图案,所述缓冲层图案包括形成在第二缓冲层中、与所述第二图案硬掩模层图形相对应的第二图案和形成在第一缓冲层中、与第一及第二图案硬掩模层叠合图形相对应的第三图案;以所述缓冲层图案为掩模,刻蚀所述介质层,所述刻蚀进行至在第二图案硬掩模层下方的第二缓冲层消失后继续进行,在第一图案硬掩模层下方的第一缓冲层消失前停止,以在所述介质层内形成多个通孔及连接至少两个通孔的沟槽;去除残留的第一缓冲层。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
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H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
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H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
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