[发明专利]非一致性存储结构实现方法及系统无效
| 申请号： | 201210518321.1 | 申请日： | 2012-12-06 |
| 公开（公告）号： | CN103853674A | 公开（公告）日： | 2014-06-11 |
| 发明（设计）人： | 王光建;吴文伍;付小军 | 申请（专利权）人： | 鸿富锦精密工业（深圳）有限公司;鸿海精密工业股份有限公司 |
| 主分类号： | G06F13/16 | 分类号： | G06F13/16 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 518109 广东省深圳市*** | 国省代码： | 广东;44 |
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| 摘要： | 一种非一致性存储结构实现方法及系统，该方法包括：控制服务器中的每个中央处理器CPU访问该服务器中的所有内存，并根据访问时间确定每个CPU的本地内存、本地远端内存及其他远端内存；获取CPU访问各内存所得的数据；当CPU访问所得数据为全局数据时，将全局静态数据放置于该CPU的其他远端内存中，将全局动态数据放置于该CPU的本地内存或本地远端内存中；及当CPU访问所得数据为局部数据时，将该局部数据放置于该CPU的本地内存中。利用本发明可以让服务器达到支持非一致性存储结构模式的效果。 | ||
| 搜索关键词： | 一致性 存储 结构 实现 方法 系统 | ||
【主权项】：
一种非一致性存储结构实现方法，其特征在于，该方法包括：控制服务器中的每个中央处理器CPU访问该服务器中的所有内存，并根据访问时间确定每个CPU的本地内存、本地远端内存及其他远端内存；获取CPU访问各内存所得的数据，该数据包括全局数据、局部读写数据和局部只读数据，其中，该全局数据包括全局静态数据和全局动态数据；当CPU访问所得数据为全局数据时，将全局静态数据放置于该CPU的其他远端内存中，将全局动态数据放置于该CPU的本地内存或本地远端内存中；当CPU访问所得数据为局部读写数据时，将该局部读写数据放置于该CPU的本地内存中，并在该CPU的本地内存的容量不足时将所述局部读写数据放置于该CPU的本地远端内存中；及当CPU访问所得数据为局部只读数据时，将该局部只读数据放置于该CPU的本地内存中。
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