[实用新型]基于阈值逻辑的SET/MOS混合结构的7-3计数器有效
| 申请号： | 201220001486.7 | 申请日： | 2012-01-05 |
| 公开（公告）号： | CN202435382U | 公开（公告）日： | 2012-09-12 |
| 发明（设计）人： | 魏榕山;陈锦锋;陈寿昌;何明华 | 申请（专利权）人： | 福州大学 |
| 主分类号： | H03K23/00 | 分类号： | H03K23/00;H03K21/10 |
| 代理公司： | 福州元创专利商标代理有限公司 35100 | 代理人： | 蔡学俊 |
| 地址： | 350002 福建省福州市铜*** | 国省代码： | 福建;35 |
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| 摘要： | 本实用新型涉及集成电路技术领域，特别是一种基于阈值逻辑的SET/MOS混合结构的7-3计数器，包括一个七输入阈值逻辑门、一个八输入阈值逻辑门和一个九输入阈值逻辑门；该电路仅由3个阈值逻辑门和2个反相器构成,共消耗5个PMOS管，5个NMOS管和3个SET。而基于布尔逻辑的CMOS7-3计数器则要消耗194个晶体管。整个电路的平均功耗仅为6.92nW。相比而言，本实用新型提出的7-3计数器管子数目大大减少，电路功耗显著降低，电路结构得到了进一步的简化，有望应用于乘法器、多输入加法器以及数字信号处理器中。 | ||
| 搜索关键词： | 基于 阈值 逻辑 set mos 混合结构 计数器 | ||
【主权项】：
一种基于阈值逻辑的SET/MOS混合结构的7‑3计数器，包括一个七输入阈值逻辑门、一个八输入阈值逻辑门和一个九输入阈值逻辑门；所述七输入阈值逻辑门的输出端经第一反相器与所述八输入阈值逻辑门的第八输入端、九输入阈值逻辑门的第八输入端连接；所述八输入阈值逻辑门的输出端经第二反相器与所述九输入阈值逻辑门的第九输入端连接；所述七、八、九输入阈值逻辑门由SET/MOS混合电路构成。
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