[发明专利]一种PMOS晶体管及其制备方法有效
申请号: | 201310015010.8 | 申请日: | 2013-01-16 |
公开(公告)号: | CN103928336B | 公开(公告)日: | 2017-05-03 |
发明(设计)人: | 赵猛 | 申请(专利权)人: | 中芯国际集成电路制造(上海)有限公司 |
主分类号: | H01L21/336 | 分类号: | H01L21/336;H01L29/78;H01L29/06 |
代理公司: | 上海光华专利事务所31219 | 代理人: | 李仪萍 |
地址: | 201203 *** | 国省代码: | 上海;31 |
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摘要: | 本发明提供一种PMOS晶体管及其制备方法,本发明形成PMOS晶体管的源极区域和漏极区域时采用依次外延生长第一应力调节层、第二应力调节层及应力保持层的方法,其中,第一应力调节层及第二应力调节层的晶格常数依次增大;在外延第二应力调节层时采用晶格常数比Ge元素更大的元素进行掺杂,使第二应力调节层形成绝大部分的源极区域和漏极区域,为沟道提供更大的压应力,使其具有更高的载流子迁移率,提高器件工作电流;第二应力调节层与衬底之间的第一应力调节层作为应力缓冲层,降低二者之间过大的晶格失配引起的缺陷;本发明采用相互间隔的第一、第二应力调节层构成三明治结构,进一步降低第二应力调节层与衬底之间过大的晶格失配引起的缺陷。 | ||
搜索关键词: | 一种 pmos 晶体管 及其 制备 方法 | ||
【主权项】:
一种PMOS晶体管的制备方法,其特征在于,所述制备方法至少包括以下步骤:提供一半导体衬底,在预制备PMOS晶体管的半导体衬底顶部形成包括源极区域、漏极区域及沟道区域的有源区,且所述源极区域和漏极区域对所述沟道区域施加压应力;其中,制备所述源极区域和漏极区域的具体步骤为:1)在所述衬底顶部预制备所述源极区域和漏极区域的位置分别形成沟槽;2)在所述沟槽中,先外延生长第一应力调节层,而后外延生长第二应力调节层,其中,所述的衬底、第一应力调节层及第二应力调节层的晶格常数依次增大;3)重复步骤2)n次,n为整数且大于等于0;4)当所述第二应力调节层的上表面与所述衬底的上表面在同一平面上时,在所述填充有第一应力调节层和第二应力调节层的沟槽上表面外延生长应力保持层,其中,所述应力保持层的材料与所述的第一应力调节层或第二应力调节层的材料一致;其中,在所述第一应力调节层上外延生长第二应力调节层时,采用原子量及晶格常数比所述第一应力调节层所掺杂元素更大的、且与衬底为同一族的元素来进行掺杂,以使所述第二应力调节层比所述第一应力调节层对沟道区域的压应力更大,从而实现沟道中更高的载流子迁移率,进而提高器件的工作电流;其中,所述衬底为IV族元素。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
H01L 半导体器件;其他类目中不包括的电固体器件
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H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
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H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
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