[发明专利]半导体集成电路无效
| 申请号： | 201310073928.8 | 申请日： | 2013-03-08 |
| 公开（公告）号： | CN103368549A | 公开（公告）日： | 2013-10-23 |
| 发明（设计）人： | 宫泽雅文;野田匡哉 | 申请（专利权）人： | 株式会社东芝 |
| 主分类号： | H03K17/687 | 分类号： | H03K17/687 |
| 代理公司： | 永新专利商标代理有限公司 72002 | 代理人： | 陈萍 |
| 地址： | 日本*** | 国省代码： | 日本;JP |
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| 摘要： | 本发明提供半导体集成电路，其特征在于，具备：第1晶体管，对使第1节点和第2节点电导通或切断进行切换；及开关控制电路，在上述第1晶体管关断的状态下，上述第1节点及上述第2节点之中的至少一方的电位比电源电位高规定电位以上的情况下，将上述第1晶体管的栅极电位设定为上述第1节点及上述第2节点的电位之中高的电位。 | ||
| 搜索关键词： | 半导体 集成电路 | ||
【主权项】：
一种半导体集成电路，其特征在于，具备：第1晶体管，对使第1节点和第2节点电导通或切断进行切换；及开关控制电路，在上述第1晶体管关断的状态下，上述第1节点及上述第2节点之中的至少一方的电位比电源电位高规定电位以上的情况下，将上述第1晶体管的基板电位设定为上述第1节点及上述第2节点的电位之中高的电位。
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