[发明专利]一种半导体器件的制造方法有效

专利信息
申请号: 201310451415.6 申请日: 2013-09-27
公开(公告)号: CN104517900B 公开(公告)日: 2018-06-08
发明(设计)人: 韩秋华;李凤莲 申请(专利权)人: 中芯国际集成电路制造(上海)有限公司
主分类号: H01L21/8238 分类号: H01L21/8238;H01L21/28
代理公司: 北京市磐华律师事务所 11336 代理人: 董巍;高伟
地址: 201203 *** 国省代码: 上海;31
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摘要: 发明提供一种半导体器件的制造方法,包括:提供半导体衬底,在半导体衬底的NMOS区和PMOS区上形成由自下而上层叠的界面层、高k介电层、覆盖层和牺牲栅极材料层构成的叠层结构;去除位于PMOS区的牺牲栅极材料层以形成凹槽;在凹槽中形成第一金属栅极;部分去除位于NMOS区的牺牲栅极材料层;采用第一远端等离子体蚀刻工艺去除位于NMOS区的牺牲栅极材料层的剩余部分,形成另一凹槽;采用第二远端等离子体蚀刻工艺去除露出的覆盖层表面的残留物质;在另一凹槽中形成第二金属栅极。根据本发明,可以独立地调节分别形成于PMOS区和NMOS区的功函数设定金属层的功函数,避免蚀刻牺牲栅极材料层时对覆盖层和高k介电层的损伤,减少层间介电层的损耗。
搜索关键词: 牺牲栅极 材料层 去除 等离子体蚀刻 半导体器件 高k介电层 金属栅极 覆盖层 衬底 远端 半导体 功函数设定金属层 蚀刻 层间介电层 覆盖层表面 叠层结构 功函数 界面层 制造 损伤 残留
【主权项】:
一种半导体器件的制造方法,包括:步骤a):提供半导体衬底,在所述半导体衬底的NMOS区和PMOS区上形成由自下而上层叠的界面层、高k介电层、覆盖层和牺牲栅极材料层构成的叠层结构;步骤b):去除位于所述PMOS区的牺牲栅极材料层以形成凹槽;步骤c):在所述凹槽中形成第一金属栅极;步骤d):部分去除位于所述NMOS区的牺牲栅极材料层;步骤e):采用第一远端等离子体蚀刻工艺去除位于所述NMOS区的牺牲栅极材料层的剩余部分,形成另一凹槽,所述蚀刻避免对所述覆盖层和高k介电层产生损伤,所述第一远端等离子体蚀刻的蚀刻气体包括H2;步骤f):采用第二远端等离子体蚀刻工艺去除露出的所述覆盖层表面的残留物质,所述第二远端等离子体蚀刻的蚀刻气体包括NF3和H2;步骤g):在所述另一凹槽中形成第二金属栅极。
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