[发明专利]一种掐头去尾移位补值电路有效
申请号: | 201310655770.5 | 申请日: | 2013-12-05 |
公开(公告)号: | CN103729163B | 公开(公告)日: | 2017-01-04 |
发明(设计)人: | 雷绍充;马璐钖 | 申请(专利权)人: | 西安交通大学 |
主分类号: | G06F7/523 | 分类号: | G06F7/523 |
代理公司: | 西安通大专利代理有限责任公司61200 | 代理人: | 陆万寿 |
地址: | 710049 陕*** | 国省代码: | 台湾;71 |
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摘要: | 本发明涉及集成电路设计领域,公开了一种掐头去尾移位补值电路,适用于大数平方运算。该发明电路结构包括:2m+1位寄存器、m+1位二选一数据选择器、m位三选一数据选择器、m位one‑hot循环计数器;其中,寄存器中m+1个奇数位的输入来自m+1位二选一数据选择器的输出,m个偶数位的输入来自m位三选一数据选择器的输出。二选一数据选择器的控制信号及三选一数据选择器的第一位控制信号为SE,控制数据的并行、串行输入方式,one‑hot循环计数器的m位输出作为三选一数据选择器的第二位控制信号,控制数据在寄存器偶数位的逐次插入。本发明可以逐步对2m+1位数据去头去尾左移后在低位重新存入数据,从而减少平方的运行时间。 | ||
搜索关键词: | 一种 掐头去尾 移位 电路 | ||
【主权项】:
一种掐头去尾移位补值电路,其特征在于:包括2m+1位寄存器、m+1位二选一数据选择器、m位三选一数据选择器、m位one‑hot循环计数器;其中,2m+1位寄存器中的m+1个奇数位寄存器的输入端分别与m+1位二选一数据选择器的输出端相连;2m+1位寄存器中的m个偶数位寄存器的输入端分别与m位三选一数据选择器的输出端相连;其中,160≤m≤15360;二选一数据选择器的控制信号端及三选一数据选择器的第一位控制信号端均与SE信号相连;m位one‑hot循环计数器的m位输出端均与三选一数据选择器的第二位控制信号端相连。
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