[发明专利]维特比蝶形运算有效

专利信息
申请号: 201310726104.6 申请日: 2013-11-06
公开(公告)号: CN103810145B 公开(公告)日: 2018-06-22
发明(设计)人: P·查德赫里;A·特萨洛咯 申请(专利权)人: 德克萨斯仪器股份有限公司
主分类号: G06F17/14 分类号: G06F17/14
代理公司: 北京纪凯知识产权代理有限公司 11245 代理人: 赵蓉民
地址: 美国德*** 国省代码: 美国;US
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摘要: 发明涉及维特比蝶形运算。一种适合于维特比解码的解码系统包括解码器[402],解码器[402]包括状态度量阵列[410]、蝶形单元[420]和约束长度多路复用器[440和460]。状态度量阵列[410]包括寄存器,其中每个寄存器被设置为存储用于处理的状态度量。蝶形单元[420]包括蝶形元件[430]阵列,其中每个蝶形元件被设置为与蝶形单元[420]中的其他蝶形元件并行产生中间状态度量。约束长度多路复用器单元[440和460]被设置为响应于中间状态度量和存储在约束长度寄存器[470]中的维特比约束长度值而产生新的状态度量。也可以响应于约束长度而产生转换比特[450]。
搜索关键词: 状态度量 蝶形单元 蝶形元件 维特比 解码器 蝶形运算 中间状态 寄存器 度量 存储 多路复用器单元 长度寄存器 多路复用器 维特比解码 解码系统 响应 并行 转换
【主权项】:
1.一种处理器,其包括:具有寄存器的状态度量阵列,其中每个寄存器被设置为存储用于处理的状态度量;包括蝶形元件阵列的蝶形单元,其中每个蝶形元件被设置为与所述蝶形单元中的其他蝶形元件并行产生中间状态度量;其中每个蝶形元件被设置为与所述蝶形单元中的其他蝶形元件并行产生中间转换比特;约束长度多路复用器单元,其被设置为响应于所述中间状态度量和存储在约束长度寄存器中的维特比约束长度值而产生转换比特;以及转换比特多路复用器单元,其被设置为响应于所述中间转换比特和存储在约束长度寄存器中的维特比约束长度值而产生所述转换比特。
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