[实用新型]基于FPGA的高速串行接口有效

专利信息
申请号: 201320074470.3 申请日: 2013-02-17
公开(公告)号: CN203070283U 公开(公告)日: 2013-07-17
发明(设计)人: 刘道森;孙艳梅;吴学峰 申请(专利权)人: 齐齐哈尔大学
主分类号: G06F13/40 分类号: G06F13/40
代理公司: 暂无信息 代理人: 暂无信息
地址: 161006 黑*** 国省代码: 黑龙江;23
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摘要: 基于FPGA的高速串行接口,属于通信领域,本实用新型为解决目前的FPGA与外界的接口不能满足日益发展的需求的问题。本实用新型包括SFP模块和FPGA,FPGA内构建核心处理器、A/D转换电路、接收FIFO、发送FIFO和D/A转换电路,SFP模块的电信号输出端与A/D转换电路的模拟信号输入端相连,A/D转换电路的数字信号输出端与接收FIFO的输入端相连,接收FIFO的输出端与核心处理器的数据输入端相连,核心处理器的数据输出端与发送FIFO的输入端相连,发送FIFO的输出端与D/A转换电路的模拟信号输出端与SFP模块的电信号输入端相连。
搜索关键词: 基于 fpga 高速 串行 接口
【主权项】:
基于FPGA的高速串行接口,其特征在于,它包括SFP模块(1)和FPGA(2),FPGA(2)内构建核心处理器(2‑1)、A/D转换电路(2‑2)、接收FIFO(2‑3)、发送FIFO(2‑4)和D/A转换电路(2‑5), SFP模块(1)的电信号输出端与A/D转换电路(2‑2)的模拟信号输入端相连,A/D转换电路(2‑2)的数字信号输出端与接收FIFO(2‑3)的输入端相连,接收FIFO(2‑3)的输出端与核心处理器(2‑1)的数据输入端相连,核心处理器(2‑1)的数据输出端与发送FIFO(2‑4)的输入端相连,发送FIFO(2‑4)的输出端与D/A转换电路(2‑5)的模拟信号输出端与SFP模块(1)的电信号输入端相连。
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