[实用新型]一种面积优化的FPGA互连结构有效
| 申请号： | 201320357469.1 | 申请日： | 2013-06-21 |
| 公开（公告）号： | CN203377863U | 公开（公告）日： | 2014-01-01 |
| 发明（设计）人： | 崔运东;王潘丰;刘成利 | 申请（专利权）人： | 京微雅格（北京）科技有限公司 |
| 主分类号： | H03K19/177 | 分类号： | H03K19/177 |
| 代理公司： | 北京亿腾知识产权代理事务所 11309 | 代理人： | 陈霁 |
| 地址： | 100083 北京市海*** | 国省代码： | 北京;11 |
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| 摘要： | 本实用新型提出一种FPGA互连结构。所述的FPGA互连结构包括第一级多路复用器和至少另一级多路复用器，其中第一级多路复用器的输出信号构成所述至少另一级多路复用器的输入信号；所述至少另一级多路复用器包括多个多路复用器，所述多个多路复用器具有相同的多位第一输入信号。多位数据通路经过基本相同的绕线路径，即每条通路的延时基本相同，从而保证了数据的正常传输，并减小了具有相同输入的多路复用器间的设计面积。 | ||
| 搜索关键词： | 一种 面积 优化 fpga 互连 结构 | ||
【主权项】：
一种FPGA互连结构，包含：第一级多路复用器和至少另一级多路复用器，其中第一级多路复用器与至少另一级多路复用器电连接；所述至少另一级多路复用器包括多个多路复用器。
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