[发明专利]驱动非易失性半导体装置的方法有效

专利信息
申请号: 201380000970.5 申请日: 2013-01-28
公开(公告)号: CN103460375B 公开(公告)日: 2016-11-02
发明(设计)人: 金子幸广 申请(专利权)人: 松下知识产权经营株式会社
主分类号: H01L21/8246 分类号: H01L21/8246;G11C11/22;H01L21/336;H01L27/105;H01L29/788;H01L29/792
代理公司: 中科专利商标代理有限责任公司 11021 代理人: 李逸雪
地址: 日本国*** 国省代码: 日本;JP
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摘要: 按照宽度WRH1以及宽度WRH2变大、宽度WRL变小的方式,将电压Vs、Vd以及V3分别施加给源电极(15)、漏电极(16)以及下部栅电极膜(12),同时在比为了使铁电膜(13)所包含的全部极化反转所需的期间还短的期间内,将脉冲电压V1以及V2分别施加给第1上部栅电极(17a)以及第2上部栅电极(17b)。脉冲电压V1以及V2比为了使铁电膜(13)所包含的全部极化反转所需的电压还小。电压Vs、Vd及V3以及脉冲电压V1以及V2满足Vs、Vd、V3<V1、V2的关系。
搜索关键词: 驱动 非易失性 半导体 装置 方法
【主权项】:
一种驱动非易失性半导体装置的方法,其具备以下工序:准备上述非易失性半导体装置的工序a,这里,上述非易失性半导体装置具备下部栅电极膜、铁电膜、半导体膜、源电极、漏电极、第1上部栅电极以及第2上部栅电极,上述下部栅电极膜、上述铁电膜以及上述半导体膜按照上述下部栅电极膜、上述铁电膜以及上述半导体膜的顺序被层叠,上述源电极、上述漏电极、上述第1上部栅电极以及上述第2上部栅电极被形成在上述半导体膜上,Z方向表示上述下部栅电极膜、上述铁电膜以及上述半导体膜的层叠方向,在俯视的情况下,上述源电极以及上述漏电极沿着X方向相互对置,在俯视的情况下,上述第1上部栅电极以及上述第2上部栅电极沿着Y方向相互对置,上述X方向以及上述Y方向相互正交,上述X方向以及上述Y方向都与上述Z方向正交,低电阻区域、第1高电阻区域以及第2高电阻区域被形成在上述半导体膜内,在俯视的情况下,上述低电阻区域沿着上述Y方向具有宽度WRL,在俯视的情况下,上述第1高电阻区域沿着上述Y方向具有宽度WRH1,在俯视的情况下,上述第2高电阻区域沿着上述Y方向具有宽度WRH2,上述宽度WRL的值为0以上,上述宽度WRH1的值为0以上,上述宽度WRH2的值为0以上,在俯视的情况下,上述低电阻区域、上述第1高电阻区域以及上述第2高电阻区域被夹在上述第1上部栅电极以及上述第2上部栅电极之间,在俯视的情况下,上述第1高电阻区域被夹在上述第1上部栅电极以及上述低电阻区域之间,在俯视的情况下,上述第2高电阻区域被夹在上述第2上部栅电极以及上述低电阻区域之间,在俯视的情况下,上述低电阻区域被夹在上述第1高电阻区域以及上述第2高电阻区域之间;将电压Vs、电压Vd以及电压V3分别施加给上述源电极、上述漏电极以及上述下部栅电极膜,以使上述宽度WRH1以及上述宽度WRH2的值变大、上述宽度WRL的值变小,同时在比为了使上述铁电膜所包含的全部极化反转所需的期间还短的期间T1这一期间内,将脉冲电压V1以及V2,分别施加给上述第1上部栅电极以及上述第2上部栅电极的工序b,这里,上述脉冲电压V1是比为了使上述铁电膜所包含的全部极化反转所需的电压还小的电压,上述脉冲电压V2是比为了使上述铁电膜所包含的全部极化反转所需的电压还小的电压,上述电压Vs、上述电压Vd、上述电压V3、上述脉冲电压V1以及上述脉冲电压V2满足以下的关系(I)Vs、Vd、V3<V1、V2   (I);以及将上述工序b反复n次,直到上述源电极以及上述漏电极之间的电阻值达到预先决定的电阻值以上为止的工序c,其中n表示2以上的整数。
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