[发明专利]一种智能卡多核处理器系统及其防御差分功耗分析的方法有效
| 申请号： | 201410018636.9 | 申请日： | 2014-01-15 |
| 公开（公告）号： | CN103986571B | 公开（公告）日： | 2018-04-20 |
| 发明（设计）人： | 景蔚亮;陈邦明 | 申请（专利权）人： | 上海新储集成电路有限公司 |
| 主分类号： | H04L9/06 | 分类号： | H04L9/06 |
| 代理公司： | 上海申新律师事务所31272 | 代理人： | 吴俊 |
| 地址： | 201500 上海市*** | 国省代码： | 上海;31 |
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| 摘要： | 本发明提出了一种智能卡多核处理器系统及其防御差分功耗分析的方法，本系统运用多核微处理器来处理并行加解密算法和数据，各个微处理器在完全互为异步的时钟信号下工作，各个微处理器工作功耗互为干扰功耗，在处理其他非加解密算法任务时，多核处理器也可以被同时打开运行，即可以用更小的功耗达到相同或者超过单核智能卡的性能，并且起到了防御差分功耗分析攻击的作用。 | ||
| 搜索关键词： | 一种 智能卡 多核 处理器 系统 及其 防御 功耗 分析 方法 | ||
【主权项】：
一种智能卡多核处理器系统，其特征在于，包括：若干个并行的微处理器，且每个所述微处理器均与一加解密算法功能子模块双向通讯连接；所述若干个并行的微处理器中包含有一主微处理器；一时钟产生模块，该时钟产生模块与所述主微处理器通讯连接；一随机数产生模块，该随机数产生模块与所述时钟产生模块通讯连接；所述随机数产生模块输出随机数序列至所述时钟产生模块，该时钟产生模块根据其接收到的随机数序列对源时钟进行分频、相位偏移，以产生所述若干个异步的时钟信号；所述若干个异步的时钟信号与所述微处理器一一对应，且任意两个所述异步的时钟信号之间的相位和频率均不相同；所述时钟产生模块发送所述若干个异步的时钟信号至每个所述微处理器，每个所述微处理器根据其接收的时钟信号处理运行与其连接的加解密算法功能子模块。
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