[发明专利]向混合可编程多核器件映射网络应用有效
申请号: | 201410093242.X | 申请日: | 2014-03-13 |
公开(公告)号: | CN104050143B | 公开(公告)日: | 2017-05-03 |
发明(设计)人: | M·D·赫顿;A·基尔科里斯 | 申请(专利权)人: | 阿尔特拉公司 |
主分类号: | G06F15/173 | 分类号: | G06F15/173 |
代理公司: | 北京市金杜律师事务所11256 | 代理人: | 酆迅,辛鸣 |
地址: | 美国加*** | 国省代码: | 暂无信息 |
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摘要: | 本发明的各实施例涉及向混合可编程多核器件映射网络应用。描述了一种混合可编程逻辑,其在接收的数据包上使用可编程逻辑元件以及与可编程逻辑元件交错的处理器执行包处理功能。报头数据可以由可编程逻辑元件调度以用于向与处理器关联的处理线程分配。处理器可以在报头数据上使用由可编程逻辑元件提供的处理线程和硬件加速功能来执行包处理功能。 | ||
搜索关键词: | 混合 可编程 多核 器件 映射 网络 应用 | ||
【主权项】:
一种混合可编程逻辑器件,包括:收发器,所述收发器接收数据包,其中所述数据包包括报头数据和有效载荷数据;包括可编程逻辑元件的可编程逻辑结构,其中所述可编程逻辑元件的第一部分提供硬件加速功能;处理器,所述处理器与可编程逻辑元件交错,其中所述处理器中的每个处理器使用所述硬件加速功能和处理线程来处理接收的所述报头数据,并且所述可编程逻辑元件的第二部分调度报头数据向所述处理线程的分配,其中所述处理器的每个处理线程与由所述处理器中的每个处理器经由由所述处理器中的每个处理器共享的互连接收的唯一地址关联,其中所述处理器中的每个处理器包括存储器接口,所述存储器接口针对与每个相应的处理线程关联的所述唯一地址监视接收的所述报头数据并且在接收的所述报头数据被用所述唯一地址标记时将接收的所述报头数据存储在本地存储器中。
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