[发明专利]数据转换器的有效时钟树在审

专利信息
申请号: 201410093828.6 申请日: 2014-03-14
公开(公告)号: CN104052488A 公开(公告)日: 2014-09-17
发明(设计)人: S·S·库;S·C·罗斯 申请(专利权)人: 美国亚德诺半导体公司
主分类号: H03M1/66 分类号: H03M1/66
代理公司: 中国国际贸易促进委员会专利商标事务所 11038 代理人: 陈华成
地址: 美国马*** 国省代码: 美国;US
权利要求书: 查看更多 说明书: 查看更多
摘要: 本申请涉及数据转换器的有效时钟树。提供了一种集成电路的多级时钟分配电路。时钟分配电路可路由共同的时钟信号到多个时钟接收器电路。分配电路中的每级可包括多个缓冲器。至少一些或所有缓冲器的输出可以通过互联而连接到彼此。互连可以对准由互联缓冲器输出的时钟信号,并从而鼓励这些时钟信号同步。也可以连接其他级的时钟分配信号。
搜索关键词: 数据 转换器 有效 时钟
【主权项】:
一种时钟分配系统,包括:多个时钟接收器,多级时钟树,具有共同时钟信号的输入以及耦合到时钟接收器的输出,每级包括时钟缓冲器阵列,其中,来自共同级的多个时钟缓冲器的输出连接在一起。
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