[发明专利]MOS晶体管和导电插塞的形成方法有效
申请号: | 201410135921.9 | 申请日: | 2014-04-04 |
公开(公告)号: | CN104979203B | 公开(公告)日: | 2018-06-01 |
发明(设计)人: | 王冬江;张海洋 | 申请(专利权)人: | 中芯国际集成电路制造(上海)有限公司 |
主分类号: | H01L21/336 | 分类号: | H01L21/336;H01L21/768 |
代理公司: | 北京集佳知识产权代理有限公司 11227 | 代理人: | 张亚利;骆苏华 |
地址: | 201203 *** | 国省代码: | 上海;31 |
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摘要: | 一种MOS晶体管和导电插塞的形成方法,其中导电插塞的形成方法包括:提供半导体基底,在所述半导体基底上形成介质层;在所述介质层上形成硬掩膜层,所述硬掩膜层内具有贯穿其厚度的开口;以所述硬掩膜层为掩膜,沿开口刻蚀介质层,形成第一通孔,所述第一通孔的底部具有聚合物层;去除所述第一通孔底部的聚合物层;继续以所述硬掩膜层为掩膜,沿第一通孔继续刻蚀所述介质层至露出半导体基底,形成第二通孔;在所述第二通孔内填充满导电层,形成导电插塞。采用本发明的方法能够提高导电插塞的性能。 | ||
搜索关键词: | 通孔 导电插塞 硬掩膜层 半导体基底 介质层 聚合物层 掩膜 开口 刻蚀介质层 导电层 刻蚀 去除 贯穿 | ||
【主权项】:
1.一种MOS晶体管的形成方法,其特征在于,包括:提供半导体衬底,在所述半导体衬底上形成栅极,在所述栅极两侧的半导体衬底中形成源极和漏极;在所述半导体衬底上形成介质层,所述介质层覆盖所述栅极、源极和漏极;在所述介质层上形成硬掩膜层,所述硬掩膜层内具有贯穿其厚度的第一开口和第二开口,所述第一开口与所述栅极位置相对应,所述第二开口与所述源极或漏极位置相对应;以所述硬掩膜层为掩膜,沿所述第一开口和第二开口刻蚀所述介质层,沿所述第一开口刻蚀所述介质层形成的接触孔为栅极接触孔,沿所述第二开口刻蚀所述介质层形成的接触孔为第一源极接触孔或第一漏极接触孔,所述栅极接触孔和第一源极接触孔的底部具有聚合物层或者所述栅极接触孔和第一漏极接触孔的底部具有聚合物层;去除所述聚合物层;继续以所述硬掩膜层为掩膜,沿第一源极接触孔或第一漏极接触孔继续刻蚀所述介质层至露出所述源极或漏极,形成第二源极接触孔或第二漏极接触孔;在所述栅极接触孔内填充满导电层形成栅极接触插塞,在所述第二源极接触孔内填充满导电层形成源极接触插塞或者在所述第二漏极接触孔内填充满导电层形成漏极接触插塞;在所述介质层上形成硬掩膜层,所述硬掩膜层内具有贯穿其厚度的第一开口和第二开口的方法包括:在所述介质层上形成硬掩膜层;在所述硬掩膜层上形成第一图形化的光刻胶层;以所述第一图形化的光刻胶层为掩膜,刻蚀所述硬掩膜层,所述硬掩膜层内具有贯穿其厚度的第一开口和第二开口。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
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H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
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H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造