[发明专利]半导体器件制备方法以及堆栈式芯片的制备方法有效

专利信息
申请号: 201410136618.0 申请日: 2014-04-04
公开(公告)号: CN103915462B 公开(公告)日: 2016-11-23
发明(设计)人: 高喜峰;叶菁 申请(专利权)人: 豪威科技(上海)有限公司
主分类号: H01L27/146 分类号: H01L27/146;H01L21/50
代理公司: 上海思微知识产权代理事务所(普通合伙) 31237 代理人: 郑玮
地址: 201210 上海市*** 国省代码: 上海;31
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摘要: 发明提供了一种半导体器件制备方法,包括:提供一基底,所述基底的一侧上具有一器件功能层;在所述器件功能层中制备一第一开口,所述第一开口贯穿所述器件功能层,所述第一开口的侧壁与所述第一开口的底壁的夹角小于90°;以所述器件功能层为掩膜,所述第一开口为掩膜图形,对所述基底进行刻蚀,在所述基底上形成一第二开口。本发明还提供一种堆栈式芯片的制备方法,采用上述的半导体器件制备方法制备第二开口。所述半导体器件制备方法可以简化半导体制备工艺,提高半导体制备工厂(FAB)产能,降低生产成本。
搜索关键词: 半导体器件 制备 方法 以及 堆栈 芯片
【主权项】:
一种半导体器件制备方法,其特征在于,包括:提供一基底,所述基底的一侧上具有一器件功能层;在所述器件功能层中制备一第一开口,所述第一开口贯穿所述器件功能层,所述第一开口的侧壁与所述第一开口的底壁的夹角小于90°;以所述器件功能层为掩膜,所述第一开口为掩膜图形,对所述基底进行刻蚀,在所述基底上形成一第二开口,所述第二开口的尺寸小于所述第一开口的底部尺寸。
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