[发明专利]一种半导体器件的制造方法有效
申请号: | 201410142632.1 | 申请日: | 2014-04-10 |
公开(公告)号: | CN104979178B | 公开(公告)日: | 2018-03-20 |
发明(设计)人: | 于书坤;韦庆松 | 申请(专利权)人: | 中芯国际集成电路制造(上海)有限公司 |
主分类号: | H01L21/28 | 分类号: | H01L21/28 |
代理公司: | 北京市磐华律师事务所11336 | 代理人: | 高伟,赵礼杰 |
地址: | 201203 *** | 国省代码: | 上海;31 |
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摘要: | 本发明提供一种半导体器件的制造方法,涉及半导体技术领域。本发明的半导体器件的制造方法,通过在形成锗硅遮蔽层以及锗硅临时侧壁的步骤之后、形成锗硅层的步骤之前增加进行氮化处理的步骤,在伪栅极硬掩膜、锗硅遮蔽层以及锗硅临时侧壁的表面形成富含氮悬垂键的结构,可以避免在锗硅工艺中在锗硅遮蔽层和锗硅临时侧壁以及伪栅极硬掩膜的表面上形成非正常的锗硅颗粒,因此可以提高制得的半导体器件的良率。 | ||
搜索关键词: | 一种 半导体器件 制造 方法 | ||
【主权项】:
一种半导体器件的制造方法,其特征在于,所述方法包括:步骤S101:提供半导体衬底,在所述半导体衬底的NMOS区和PMOS区分别形成包括伪栅极和伪栅极硬掩膜的伪栅极结构;步骤S102:形成覆盖所述半导体衬底以及所述伪栅极硬掩膜的遮蔽材料层,对所述遮蔽材料层进行刻蚀以形成覆盖NMOS区的锗硅遮蔽层以及位于PMOS的伪栅极两侧的锗硅临时侧壁;步骤S103:在所述半导体衬底内形成位于PMOS的伪栅极两侧的用于容置锗硅层的沟槽;步骤S104:在所述沟槽内形成锗硅层;其中,在所述步骤S102与所述步骤S104之间还包括:对所述伪栅极硬掩膜、所述锗硅遮蔽层以及所述锗硅临时侧壁进行氮化处理的步骤,从而使表面富含氮悬垂键。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
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H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
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