[发明专利]存储器阵列有效
| 申请号： | 201410465835.4 | 申请日： | 2014-09-12 |
| 公开（公告）号： | CN105405463B | 公开（公告）日： | 2019-11-22 |
| 发明（设计）人： | 杨光军 | 申请（专利权）人： | 上海华虹宏力半导体制造有限公司 |
| 主分类号： | G11C16/10 | 分类号： | G11C16/10;G11C16/06 |
| 代理公司： | 31237 上海思微知识产权代理事务所(普通合伙) | 代理人： | 郑玮<国际申请>=<国际公布>=<进入国 |
| 地址： | 201203 上海市浦东*** | 国省代码： | 上海;31 |
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| 摘要： | 本发明公开了一种存储器阵列，该存储器阵列包括多个基本单元阵、字线组及位线组，每个基本单元阵包括2×2个存储单元对，字线组包括字线WL<m>、第一控制栅线CG<m>，位线组包括位线BL0<m>、BL1<m>和选择信号线S<m>，该多个基本单元阵在列行方向依次由该位线组和字线组级联，其形成的各列纵向单元阵和其他列单元阵没有关联，通过本发明，存储器阵列的列方向每一组存储单元和其他组存储单元没有关联，译码简单，适合银行卡的开发。 | ||
| 搜索关键词： | 存储器阵列 基本单元 位线组 字线组 组存储单元 关联 选择信号线 存储单元 控制栅线 纵向单元 列单元 列方向 银行卡 级联 位线 译码 字线 开发 | ||
【主权项】：
1.一种存储器阵列，其特征在于：该存储器阵列包括多个基本单元阵、字线组及位线组，每个基本单元阵包括2×2个存储单元对，字线组包括字线WL<m>、第一控制栅线CG<m>，位线组包括位线BL0<m>、BL1<m>和选择信号线S<m>，该多个基本单元阵在列行方向依次由该位线组和字线组级联，其形成的各列纵向单元阵和其他列单元阵没有关联，字节选择控制模块通过选中或者不选中每个字节的字线WL，来实现字节的选择；/n其中，对每一个基本单元阵的各存储单元对，该第一控制栅线CG<m>连接其第一控制栅极和第二控制栅极，该字线WL<m>连接字线控制栅极；/n定义各存储单元对的源漏极的上端为漏极，定义各存储单元对的源漏极的下端为源极，对该存储器阵列的奇数行奇数列存储单元对，位线BL0<n>连接其漏极，选择信号线S<n>连接其源极，对奇数行偶数列存储单元对，位线BL1<n>连接其漏极，选择信号线S<n>连接其源极，对偶数行奇数列存储单元对，位线BL0<n>连接其源极，位线选择信号线S<n>连接其漏极，对偶数行偶数列存储单元对，位线BL1<n>连接其源极，选择信号线S<n>连接其漏极。/n
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