[发明专利]用于降低DAC中的电容器感应的ISI的方法和设备有效
| 申请号： | 201410533057.8 | 申请日： | 2014-10-11 |
| 公开（公告）号： | CN104579341B | 公开（公告）日： | 2018-06-19 |
| 发明（设计）人： | S·拉加塞卡 | 申请（专利权）人： | 亚德诺半导体集团 |
| 主分类号： | H03M1/10 | 分类号： | H03M1/10 |
| 代理公司： | 中国国际贸易促进委员会专利商标事务所 11038 | 代理人： | 郭思宇 |
| 地址： | 百慕大群岛(*** | 国省代码： | 百慕大群岛;BM |
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| 摘要： | 本发明涉及用于降低DAC中的电容器感应的ISI的方法和设备。一种电路可包括多个主数模(DAC)元件，用于将数字输入信号转换成模拟输出信号。控制电路可控制每个主DAC元件以根据数字输入信号而在第一状态和第二状态之间切换从而在输出处提供表示数字输入信号的模拟输出信号。多个校正性DAC元件可被并行地耦接至控制电路和输出之间的多个主DAC元件。多个校正性DAC元件可被控制来减轻由于主DAC元件中的寄生电容导致的码间干扰(ISI)。多个校正性DAC元件可能不向模拟输出信号贡献直流电流。 1 | ||
| 搜索关键词： | 模拟输出信号 校正性 电容器 数字输入信号 方法和设备 控制电路 数字输入信号转换 寄生电容 码间干扰 直流电流 可控制 输出处 数模 耦接 并行 电路 输出 | ||
【主权项】：
1.一种电路，包括：多个主数模DAC元件，用于将数字输入信号转换成模拟输出信号；控制电路，用于控制每个主DAC元件以根据数字输入信号在第一状态和第二状态之间切换从而在输出处提供表示数字输入信号的模拟输出信号；以及多个校正性DAC元件，其被并行地耦接至控制电路和输出之间的多个主DAC元件，其中控制电路控制每个校正性DAC元件以在第一状态和第二状态之间切换，从而使得由主DAC元件和校正性DAC元件的寄生电容从输出汲取的电荷恒定。
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