[发明专利]处理器及其操作方法、以及计算机可读存储介质有效

专利信息
申请号: 201480065193.7 申请日: 2014-11-26
公开(公告)号: CN105793832B 公开(公告)日: 2018-12-18
发明(设计)人: 道格拉斯·R·瑞德 申请(专利权)人: 上海兆芯集成电路有限公司
主分类号: G06F13/14 分类号: G06F13/14
代理公司: 北京林达刘知识产权代理事务所(普通合伙) 11277 代理人: 刘新宇
地址: 201203 上海市浦东新区上*** 国省代码: 上海;31
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摘要: 一种处理器,包含多个处理核与由该多个处理核共用的一快取存储器。该快取存储器包含一合并引擎,用以自该多个处理核中的各个处理核接收一个别请求,并据此执行与该快取存储器相关的一操作。该合并引擎将来自该多个处理核中两个或更多个处理核的多个个别请求合并为一合并后请求。该合并引擎通过执行一单一操作来执行该合并后请求,并于该单一操作完成时,通知该多个处理核中的两个或更多个处理核,其个别请求已经完成。
搜索关键词: 管理 请求 合并
【主权项】:
1.一种处理器,包含:多个处理核;以及一集合相联快取存储器,具有多个关联路且由该多个处理核共用,其中该快取存储器包含一合并引擎,该合并引擎用以接收来自该多个处理核中的各个处理核的各自请求以执行对该快取存储器的快取管理操作;其中该合并引擎将来自该多个处理核中两个或更多个处理核的各自请求合并为一合并后请求,该合并引擎通过执行一单一快取管理操作来执行该合并后请求,并于对该快取存储器的该单一快取管理操作完成时,通知该多个处理核中的该两个或更多个处理核的每一处理核其各自请求已经完成;其中,该快取存储器包含多个快取项目,每一个快取项目包含用以存放一快取列及该快取列的相关状态的储存;以及对该快取存储器的快取管理操作包含使该合并引擎检查该快取存储器的多个关联路的至少一关联路的多个快取项目中每一快取项目的快取列状态。
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