[发明专利]用于实现动态无序处理器流水线的方法和装置有效

专利信息
申请号: 201510091809.4 申请日: 2015-02-28
公开(公告)号: CN104951281B 公开(公告)日: 2018-08-24
发明(设计)人: D·M·卡提科夫;N·尼尔拉坎塔姆;J·H·凯尔姆;P·谢卡拉科斯 申请(专利权)人: 英特尔公司
主分类号: G06F9/38 分类号: G06F9/38
代理公司: 上海专利商标事务所有限公司 31100 代理人: 何焜
地址: 美国加利*** 国省代码: 美国;US
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摘要: 本申请公开了用于实现动态无序处理器流水线的方法和装置。一种用于优化的动态无序超长指令字(VLIW)流水线的硬件/软件协同设计。例如,装置的一个实施例包括:指令取出单元,其用于将超长指令字(VLIW)按其程序顺序从存储器中取出,VLIW中的每一个包括多个精简指令集计算(RISC)指令字节,这些字节按照去除它们之间的数据流依赖关系和假输出依赖关系的顺序被集中到VLIW中;解码单元,其用于按照VLIW的程序顺序对其进行解码,并且并行地输出每个经解码的VLIW的字节;以及无序执行引擎,其用于优选地并行于其他字节来执行这些字节,其中,以不同于从解码单元中接收这些字节的顺序来执行这些字节中的至少一些,无序执行引擎具有在执行操作时不检查这些字节之间的数据流依赖关系和假输出依赖关系的一个或多个处理级。
搜索关键词: 用于 实现 动态 无序 处理器 流水线 方法 装置
【主权项】:
1.一种装置,包括:指令取出单元,所述指令取出单元用于按照程序顺序从存储器中取出超长指令字VLIW,所述超长指令字VLIW中的每一个包括多个精简指令集计算RISC指令字节,所述字节按照去除所述字节之间的数据流依赖关系和假输出依赖关系的顺序被集中到所述超长指令字VLIW中;解码单元,所述解码单元用于按照程序顺序解码所述超长指令字VLIW,并且并行地输出每个经解码的超长指令字VLIW中的所述字节;无序执行引擎,所述无序执行引擎用于并行于所述字节中的其他字节执行所述字节中的至少一些,其中,以不同于从所述解码单元接收到所述字节的顺序来执行所述字节中的至少一些,所述无序执行引擎具有在执行操作时不检查所述字节之间的数据流依赖关系和假输出依赖关系的一个或多个处理级;以及转换器,所述转换器用于将程序代码从高级编程语言或公共指令集架构ISA格式转换成包括超长指令字VLIW和字节的私有ISA格式。
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