[发明专利]验钞装置、验钞系统及验钞方法有效

专利信息
申请号: 201510142451.3 申请日: 2015-03-27
公开(公告)号: CN104751558B 公开(公告)日: 2017-11-07
发明(设计)人: 周艳玲 申请(专利权)人: 深圳怡化电脑股份有限公司;深圳市怡化时代科技有限公司;深圳市怡化金融智能研究院
主分类号: G07D7/00 分类号: G07D7/00
代理公司: 深圳市深软翰琪知识产权代理有限公司44380 代理人: 吴雅丽
地址: 518000 广东省深圳市福*** 国省代码: 广东;44
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摘要: 发明实施例提供了一种验钞装置、验钞系统及验钞方法,所述方法包括同步信号发送步骤产生并通过GPIO发送帧同步信号;采集打包步骤;初始化步骤根据接收到的帧同步信号产生GPIO中断,进行初始化操作并开启定时器以准备接收数据;数据接收步骤;帧中断判断步骤;帧中断处理步骤;异常处理步骤触发定时器中断,异常计数器的值加1并关闭定时器;及验钞判断步骤。本发明实施例通过采用帧同步信号和定时器中断配合的方式及时发现并统计钞票数据异常,钞票间数据独立性好,不会因为一张钞票的数据异常影响下一张钞票的数据,降低了出现批量不明钞的概率,提高了验钞效率。
搜索关键词: 装置 系统 方法
【主权项】:
一种验钞方法,其特征在于,所述验钞方法包括:同步信号发送步骤:FPGA单元产生并通过GPIO发送帧同步信号;采集打包步骤:FPGA单元采集钞票对应的图像、磁性及厚度数据并打包发送;初始化步骤:DSP单元根据接收到的帧同步信号产生GPIO中断,进行初始化操作并开启定时器以准备接收数据;数据接收步骤:DSP单元接收验钞数据;帧中断判断步骤:DSP单元判断是否产生帧中断,若是则进入帧中断处理步骤,若否则进入异常处理步骤;帧中断处理步骤:DSP单元关闭定时器中断;异常处理步骤:DSP单元触发定时器中断,异常计数器的值加1并关闭定时器;及验钞判断步骤:DSP单元判断验钞是否结束,若是则结束流程,若否则返回同步信号发送步骤。
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