[发明专利]记忆体装置有效
| 申请号： | 201510266961.1 | 申请日： | 2015-05-22 |
| 公开（公告）号： | CN104978988B | 公开（公告）日： | 2017-08-25 |
| 发明（设计）人： | 黄圣财;张家璜;吴瑞仁 | 申请（专利权）人： | 江苏时代全芯存储科技有限公司;英属维京群岛商时代全芯科技有限公司 |
| 主分类号： | G11C7/12 | 分类号： | G11C7/12 |
| 代理公司： | 北京律诚同业知识产权代理有限公司11006 | 代理人： | 徐金国 |
| 地址： | 223001 江苏*** | 国省代码： | 江苏;32 |
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| 摘要： | 一种记忆体装置。记忆体装置包含记忆体阵列、字符线驱动器及n个源极驱动器。记忆体阵列包含配置于多列与至少一行的多个记忆单元，配置于同一行的记忆单元电性耦接至相应的位线，配置于同一列的记忆单元电性耦接至相应的字符线，配置于所述列的记忆单元分为n个群组，n大于等于2。字符线驱动器用以选择性地致能字符线。n个源极驱动器分别耦接n个群组的记忆单元，用以输出n个源极控制信号。当n个群组中的第一群组的任一字符线被致能时，相应于第一群组以及其读写次序相邻的第二群组的源极控制信号被相应的源极驱动器控制于选择准位。透过将记忆单元分组，可节省源极驱动器的数量，并透过控制源极控制信号抑制位线上的漏电流。 | ||
| 搜索关键词： | 记忆体 装置 及其 驱动 方法 | ||
【主权项】：
一种记忆体装置，其特征在于，包含：一记忆体阵列，该记忆体阵列包含配置于多列与至少一行的多个记忆单元，其中，配置于同一行的记忆单元电性耦接至相应的一位线，配置于同一列的记忆单元电性耦接至相应的一字符线，配置于所述列的记忆单元分为n个群组，其中n大于等于2；一字符线驱动器，用以选择性地致能所述字符线；n个源极驱动器，分别耦接该n个群组的记忆单元，用以输出n个源极控制信号；当该n个群组中的一第一群组的任一字符线被致能时，相应于该第一群组以及其读写次序相邻的一第二群组的所述源极控制信号被相应的源极驱动器控制于一选择准位。
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