[发明专利]基于FPGA和DSP的大斜视雷达成像装置和成像方法有效
申请号: | 201510305600.3 | 申请日: | 2015-06-03 |
公开(公告)号: | CN105044718B | 公开(公告)日: | 2017-06-20 |
发明(设计)人: | 李亚超;冉聃;全英汇;邢孟道;许斌 | 申请(专利权)人: | 西安电子科技大学 |
主分类号: | G01S13/90 | 分类号: | G01S13/90 |
代理公司: | 西安睿通知识产权代理事务所(特殊普通合伙)61218 | 代理人: | 惠文轩 |
地址: | 710071*** | 国省代码: | 陕西;61 |
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摘要: | 本发明公开了一种基于FPGA和DSP的大斜视高分辨率雷达成像方法,其思路是将得到的第一幅图数据、第二幅图数据、第三幅图数据和第四幅图数据进行乒乓传送,第一DSP1接收第一幅图数据后发送至第二DSP处理后回发至第一DSP,第一DSP再将处理过的第一幅图数据发送至FPGA,第四DSP收到第二幅图数据后发送至第三DSP处理后回发至第四DSP,第四DSP再将处理过的第二幅图数据发送至FPGA;第一DSP收到第三幅图数据处理后发送至FPGA,第四DSP收到第四幅图数据处理后发送至FPGA,FPGA再将处理过的各幅图数据发送至第五DSP5后再发送至PC显示器上,PC显示器依次显示处理过的各幅图数据。 | ||
搜索关键词: | 基于 fpga dsp 斜视 雷达 成像 装置 方法 | ||
【主权项】:
一种基于FPGA和DSP的大斜视雷达成像装置,其特征在于,包括:FPGA、第一DSP、第二DSP、第三DSP、第四DSP、第五DSP以及PC显示器;所述FPGA设置有第一串行高速接口、第二串行高速接口和第三串行高速接口;所述第一串行高速接口依次串联连接第一DSP和第二DSP;所述第二串行高速接口依次串联连接第四DSP和第三DSP;所述第三串行高速接口连接第五DSP,第五DSP通过以太网连接所述PC显示器;所述FPGA处理接收到的雷达回波数据,得到低速率基带信号,并将低速率基带信号以两幅图的数据量为一组传输数据进行乒乓传送,第一组传输数据包含第一幅图像数据、第二幅图像数据,第二组传输数据包含第三幅图像数据、第四幅图像数据;所述第一DSP接收FPGA发来的第一幅图像数据后,通过超链接高速接口将第一幅图像数据传送至第二DSP;所述第一DSP再接收FPGA发来的第三幅图像数据,进行大斜视高分辨率SAR图像处理;所述第二DSP对第一幅图像数据做大斜视高分辨率SAR图像处理,第二DSP完成第一幅图像数据的大斜视高分辨率SAR图像处理,并且收到新的一幅图像数据后,将第一幅图像数据的大斜视高分辨率SAR图像通过超链接高速接口发送至第一DSP;所述第一DSP完成第三幅图像数据的大斜视高分辨率SAR图像处理后,将接收到的第一幅图像数据的大斜视高分辨率SAR图像通过串行高速接口发送至FPGA;所述第一DSP完成第三幅图像数据的大斜视高分辨率SAR图像处理并且收到新的一幅图像数据后,将第三幅图像数据的大斜视高分辨率SAR图像通过串行高速接口发送至FPGA;所述第四DSP收到FPGA发来的第二幅图像数据后,通过超链接高速接口将第二幅图像数据传送至第三DSP;所述第三DSP对第二幅图像数据做大斜视高分辨率SAR图像处理,第三DSP完成第二幅图像数据的大斜视高分辨率SAR图像处理并且收到新的一幅图像数据后,将第二幅图像数据的大斜视高分辨率SAR图像通过超链接高速接口发送至第四DSP;所述第四DSP收到FPGA发来的第四幅图像数据后,进行大斜视高分辨率SAR图像处理,第四DSP完成第四幅图像数据的大斜视高分辨率SAR图像处理后,将接收到的第二幅图像数据的大斜视高分辨率SAR图像通过串行高速接口发送至FPGA;所述第四DSP完成第四幅图像数据的大斜视高分辨率SAR图像处理,并且收到新的一幅图像数据后,将第四幅图像数据的大斜视高分辨率SAR图像通过串行高速接口发送至FPGA;所述第五DSP接收第一幅图像数据的大斜视高分辨率SAR图像、第二幅图像数据的大斜视高分辨率SAR图像、第三幅图像数据的大斜视高分辨率SAR图像、第四幅图像数据的大斜视高分辨率SAR图像后,通过以太网将第一幅图像数据的大斜视高分辨率SAR图像、第二幅图像数据的大斜视高分辨率SAR图像、第三幅图像数据的大斜视高分辨率SAR图像、第四幅图像数据的大斜视高分辨率SAR图像发送至PC显示器;所述PC显示器依次显示第一幅图像数据的大斜视高分辨率SAR图像、第二幅图像数据的大斜视高分辨率SAR图像、第三幅图像数据的大斜视高分辨率SAR图像、第四幅图像数据的大斜视高分辨率SAR图像。
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