[发明专利]一种单粒子加固FPGA的查找表电路有效
| 申请号： | 201510616844.3 | 申请日： | 2015-09-24 |
| 公开（公告）号： | CN105356875B | 公开（公告）日： | 2018-07-06 |
| 发明（设计）人： | 赵元富;方新嘉;陈雷;李学武;张彦龙;王浩弛;邓先坤;林彦君;孙雷;于晓华 | 申请（专利权）人： | 北京时代民芯科技有限公司;北京微电子技术研究所 |
| 主分类号： | H03K19/177 | 分类号： | H03K19/177 |
| 代理公司： | 中国航天科技专利中心 11009 | 代理人： | 臧春喜 |
| 地址： | 100076 北*** | 国省代码： | 北京;11 |
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| 摘要： | 本发明提出了一种单粒子加固FPGA的查找表电路，包括单粒子加固静态随机存储器模块DICE、二输入多路选择器MUX和缓存BUFF。可以实现具有可选锁存功能的多路选择器。通过配置相应的存储单元，该LUT可以用来实现一个具有锁存功能的多路选择器、不带锁存的多路选择器和正常的查找表。本发明在实现具有可选锁存功能的多路选择器时，能够极大减少单粒子加固FPGA使用中需要实现大规模多路选择器时逻辑资源的占用率，为单粒子加固FPGA用户在逻辑设计中实现大规模的多路选择器提供了更优的一种选择。 | ||
| 搜索关键词： | 多路选择器 单粒子 锁存 查找表电路 可选 逻辑设计 二输入多路选择器 静态随机存储器 存储单元 逻辑资源 查找表 占用率 配置 | ||
【主权项】：
1.一种单粒子加固FPGA的查找表电路，其特征在于：包括2n个单粒子加固静态随机存储器模块DICE、二输入多路选择器MUX和缓存BUFF，n是查找表电路选择端的级数，第m级查找表电路选择端包括2n‑m个二输入多路选择器MUX；每个单粒子加固静态随机存储器模块DICE的输入端，包括用户数据接口IN、用户数据使能接口OE、配置接口R和配置选通接口WL，在用户数据使能接口OE使能时，DICE接收通过用户数据接口IN写入的用户数据并输出；在配置选通接口WL使能时，配置码流通过配置接口R写入到DICE中并输出；每两个单粒子加固静态随机存储器模块DICE的输出作为第一级查找表电路选择端上一个MUX的输入；第一级查找表电路选择端上第j和第j+1个MUX的输出作为第二级查找表电路选择端上第j个MUX的输入，j是不为0的自然数；依次类推，第n级查找表电路选择端上MUX的输出通过缓存BUFF后向外输出；所述每一级查找表电路选择端上MUX的选择端均连接到该级的查找表电路选择端；所述二输入多路选择器MUX为传输门结构，n＝4、5或6，m为自然数，m∈[1,n]。
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