[发明专利]QSGMII PCS发送方向状态机时分复用的架构、其控制方法及系统在审
| 申请号： | 201510672692.9 | 申请日： | 2015-10-15 |
| 公开（公告）号： | CN105391508A | 公开（公告）日： | 2016-03-09 |
| 发明（设计）人： | 贺伟 | 申请（专利权）人： | 盛科网络（苏州）有限公司 |
| 主分类号： | H04J3/06 | 分类号： | H04J3/06 |
| 代理公司： | 苏州威世朋知识产权代理事务所(普通合伙) 32235 | 代理人： | 杨林洁 |
| 地址： | 215021 江苏省苏州市*** | 国省代码： | 江苏;32 |
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| 摘要： | 本发明提供一种QSGMII PCS发送方向状态机时分复用的架构、其控制方法及系统，所述方法包括：设置一个GMII接口依次接收数据；在相同时钟周期下，4条所述逻辑通道依次时分复用同一个ordered_set状态机、code_group状态机对数据进行处理。本发明在整个数据处理过程中，在现有技术设置两个时钟的基础上仅保留一个时钟，使4条逻辑通道时分复用同一个ordered_set状态机和code_group状态机，并在相同的时钟周期下，将code_group状态机传递的数据直接进行编码后在一条物理链路上输出；如此，无需对数据进行跨时钟域的处理，有效的减少逻辑资源的使用，同时，上述状态机的时分复用，还可以有效的降低芯片的面积，降低芯片的研发及使用成本。 | ||
| 搜索关键词： | qsgmii pcs 发送 方向 状态机 时分 架构 控制 方法 系统 | ||
【主权项】：
一种QSGMII PCS发送方向状态机时分复用的架构，其特征在于，所述架构包括：4条逻辑通道；对应所述4条逻辑通道仅配置具有单一频率的一个时钟；在相同时钟周期下，时分复用4条所述逻辑通道的一个ordered_set状态机和一个code_group状态机；以及，为每条逻辑通道分别配置的ordered_set状态锁存器和code_group状态锁存器。
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