[发明专利]一种延迟锁相环及其滤波更新控制方法在审
| 申请号： | 201510793693.9 | 申请日： | 2015-11-17 |
| 公开（公告）号： | CN105281755A | 公开（公告）日： | 2016-01-27 |
| 发明（设计）人： | 刘成;王嵩 | 申请（专利权）人： | 西安紫光国芯半导体有限公司 |
| 主分类号： | H03L7/08 | 分类号： | H03L7/08 |
| 代理公司： | 西安通大专利代理有限责任公司 61200 | 代理人： | 徐文权 |
| 地址： | 710055 陕西省西安*** | 国省代码： | 陕西;61 |
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| 摘要： | 本发明公开一种延迟锁相环的滤波更新控制方法，包括以下步骤：当电源关闭模式退出后，存储器控制系统发出电源关闭模式退出信号给计数器，计数器输出第一信号给逻辑控制电路；逻辑控制电路通过更新速度电路控制延迟链，使其在连续若干次用1step/(m*tck)的更新速度往同一方向更新后，将更新速度调整为1step/(k*tck)，其中k>m。本发明在电源关闭模式退出时，DLL能够自动调整更新速度，避免了错误的过多的更新而产生过冲；以保证VCLK和DQS的上升沿对齐，系统操作不会出现错误。 | ||
| 搜索关键词： | 一种 延迟 锁相环 及其 滤波 更新 控制 方法 | ||
【主权项】：
1.一种延迟锁相环，其特征在于，包括延迟链、鉴相器、反馈电路、增/减电路、更新速度电路、逻辑控制电路和可配置计数器；输入时钟信号线连接延迟链和鉴相器；延迟链的输出端连接输出时钟信号线；反馈电路的输入端连接延迟链的输出端，反馈电路的输出端连接鉴相器；鉴相器的输出端连接逻辑控制电路，逻辑控制电路的输出端通过增/减电路和更新速度电路连接延迟链；可配置计数器的输入端连接存储器控制系统，用于接收存储器控制系统发出的电源关闭模式退出信号，可配置计数器的输出端连接逻辑控制电路；当电源关闭模式退出后，存储器控制系统发出电源关闭模式退出信号给可配置计数器，可配置计数器输出第一信号给逻辑控制电路；逻辑控制电路通过更新速度电路控制延迟链，使其在连续若干次用1step/(m*tck)的更新速度往同一方向更新后，将更新速度调整为1step/(k*tck)，其中k>m。
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