[发明专利]半导体结构的制造方法有效
申请号: | 201510923214.0 | 申请日: | 2015-12-11 |
公开(公告)号: | CN106876273B | 公开(公告)日: | 2019-12-03 |
发明(设计)人: | 周飞 | 申请(专利权)人: | 中芯国际集成电路制造(上海)有限公司;中芯国际集成电路制造(北京)有限公司 |
主分类号: | H01L21/336 | 分类号: | H01L21/336;H01L21/8234 |
代理公司: | 11227 北京集佳知识产权代理有限公司 | 代理人: | 高静;吴敏<国际申请>=<国际公布>=< |
地址: | 201203 *** | 国省代码: | 上海;31 |
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摘要: | 一种半导体结构的制造方法,包括:形成包括第一区域和第二区域的衬底;在衬底上形成图形化的硬掩膜层;在第一区域形成第一伪栅结构,包括第一伪栅氧化层和第一伪栅电极层,在第二区域形成第二伪栅结构,包括第二伪栅氧化层和第二伪栅电极层;去除第一伪栅结构顶部的硬掩膜层和第一伪栅结构;在第一鳍部表面形成第一栅氧化层;去除第二伪栅结构顶部的硬掩膜层和第二伪栅结构;分别在第一区域、第二区域形成第一栅极结构和第二栅极结构。本发明采用硬掩膜层保护第二伪栅结构,避免第二伪栅电极层因形成第一栅氧化层的氧化工艺而被氧化形成氧化层,从而避免去除氧化层的工艺对介质层造成损耗,进而提高半导体器件的电学性能。 | ||
搜索关键词: | 半导体 结构 制造 方法 | ||
【主权项】:
1.一种半导体结构的制造方法,其特征在于,包括:/n形成半导体基底,所述半导体基底包括衬底、凸出于所述衬底的鳍部,所述衬底包括第一区域和第二区域,凸出于所述第一区域衬底的鳍部为第一鳍部,凸出于所述第二区域衬底的鳍部为第二鳍部;所述第一区域用于形成周边器件,所述第二区域用于形成核心器件;/n在所述半导体基底表面形成伪栅氧化膜以及位于所述伪栅氧化膜表面的伪栅电极膜,在所述伪栅电极膜表面形成图形化的硬掩膜层;/n以所述硬掩膜层为掩膜,刻蚀所述伪栅电极膜和伪栅氧化膜,在所述第一鳍部表面形成第一伪栅结构并在所述第二鳍部表面形成第二伪栅结构,其中,所述第一伪栅结构包括第一伪栅氧化层和第一伪栅电极层,所述第二伪栅结构包括第二伪栅氧化层和第二伪栅电极层;/n在所述半导体基底表面形成介质层,所述介质层与所述硬掩膜层齐平并露出所述硬掩膜层顶部表面;/n去除所述第一伪栅电极层表面的硬掩膜层和第一伪栅结构,暴露出所述第一鳍部的部分表面并在所述介质层内形成第一开口;/n在所述第一开口底部的第一鳍部表面形成第一栅氧化层;/n在形成所述第一栅氧化层之后,去除所述第二伪栅电极层表面的硬掩膜层和第二伪栅结构,暴露出所述第二鳍部的部分表面并在所述介质层内形成第二开口;/n在所述第一栅氧化层表面、第一开口侧壁以及第二开口的底部和侧壁上形成栅介质层;/n在所述第一开口和第二开口中填充金属层,位于所述第一开口中的第一栅氧化层、栅介质层和金属层构成第一栅极结构,位于所述第二开口中的栅介质层和金属层构成第二栅极结构。/n
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
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