[发明专利]时钟相位对齐有效

专利信息
申请号: 201580021978.9 申请日: 2015-04-16
公开(公告)号: CN107077163B 公开(公告)日: 2020-06-09
发明(设计)人: M·林托南;J·科霍拉;M·皮萨;O·瓦基 申请(专利权)人: 瑞典爱立信有限公司
主分类号: G06F1/06 分类号: G06F1/06;H04W52/02;H03K5/00
代理公司: 中国专利代理(香港)有限公司 72001 代理人: 叶晓勇;杨美灵
地址: 瑞典斯*** 国省代码: 暂无信息
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摘要: 时钟生成电路,操作以在维持时钟信号之间的预定相位关系的同时禁能和使能多个输出时钟信号。将参考时钟信号除以至少为2的因子以生成主时钟信号。每个独立地被使能的多个相位电路通过划分参考时钟信号来生成多个输出时钟信号。输出时钟信号相对于彼此具有预定相位关系。每个相位电路与主时钟信号的同步沿同步地被使能。与每个相位电路相关联的同步电路通过仅在与输出时钟相关联的时钟使能信号被断言并且预定数目的主时钟信号同步沿的接收的条件下输出相位电路使能信号来确保与主时钟信号的同步。
搜索关键词: 时钟 相位 对齐
【主权项】:
一种禁能和使能时钟信号以恢复所述时钟信号之间的相对相位关系的方法,包括:接收参考时钟信号;将所述参考时钟信号除以至少因子2以生成主时钟信号;在第一相位电路中根据所述参考时钟信号并且与所述主时钟信号同步地生成第一输出时钟信号;在第二相位电路中根据所述参考时钟信号并且与所述主时钟信号同步地生成第二输出时钟信号,所述第二输出时钟信号与所述第一输出时钟信号具有预定相位关系;禁能所述第一相位电路和所述第二相位电路中的一个或多个相位电路以抑制相应输出时钟信号的生成;以及与所述主时钟信号同步地使能被禁能的相位电路,使得在使能所述相位电路之后所述第一输出时钟信号和所述第二输出时钟信号之间的所述预定相位关系被恢复。
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