[发明专利]低温多晶硅TFT基板的制作方法及低温多晶硅TFT基板有效
申请号: | 201610068662.1 | 申请日: | 2016-02-01 |
公开(公告)号: | CN105702622B | 公开(公告)日: | 2019-02-01 |
发明(设计)人: | 卢改平 | 申请(专利权)人: | 武汉华星光电技术有限公司 |
主分类号: | H01L21/77 | 分类号: | H01L21/77;H01L27/12 |
代理公司: | 深圳市德力知识产权代理事务所 44265 | 代理人: | 林才桂 |
地址: | 430070 湖北省武汉市*** | 国省代码: | 湖北;42 |
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摘要: | 本发明提供一种低温多晶硅TFT基板的制作方法及低温多晶硅TFT基板。本发明的低温多晶硅TFT基板的制作方法,利用化学气相沉积方法来形成N型重掺杂非晶硅层,节省一道离子掺杂的制程,且多晶硅层的图形化处理与N型重掺杂非晶硅层的图形化处理采用相同的光罩,从而节省一道光罩,降低生产成本;栅极绝缘层的厚度均匀,可有效提高TFT元件的信赖性并改善Hump现象;由于第一、第二N型重掺杂非晶硅层中掺杂的离子浓度均匀,从而避免出现过孔处源/漏极与第一、第二N型重掺杂非晶硅层的接触阻抗过大的问题,提升TFT元件特性。本发明的低温多晶硅TFT基板,制程简单,制作成本低,且TFT器件性能优异。 | ||
搜索关键词: | 低温 多晶 tft 制作方法 基板 | ||
【主权项】:
1.一种低温多晶硅TFT基板的制作方法,其特征在于,包括如下步骤:步骤1、提供一基板(10),在所述基板(10)上形成缓冲层(20),利用化学气相沉积方法在所述缓冲层(20)上沉积一N型重掺杂非晶硅层(30),利用一道光罩,采用正型光阻通过黄光、蚀刻制程对所述N型重掺杂非晶硅层(30)进行图形化处理,得到位于两侧的第一N型重掺杂非晶硅层(31)与第二N型重掺杂非晶硅层(32);步骤2、在所述第一、第二N型重掺杂非晶硅层(31、32)上沉积一非晶硅层,采用低温结晶工艺将所述非晶硅层转化为多晶硅层(40),利用与所述步骤1相同的光罩,采用负型光阻通过黄光、蚀刻制程对所述多晶硅层(40)进行图形化处理,得到位于所述第一N型重掺杂非晶硅层(31)与第二N型重掺杂非晶硅层(32)之间的多晶硅段(41);步骤3、在所述第一、第二N型重掺杂非晶硅层(31、32)、及多晶硅段(41)上沉积栅极绝缘层(50),在所述栅极绝缘层(50)上形成对应于多晶硅段(41)上方的栅极(60);然后利用栅极(60)为光罩对所述多晶硅段(41)的两侧进行N型轻掺杂,得到第一N型轻掺杂多晶硅层(42)、第二N型轻掺杂多晶硅层(43)、及位于所述第一、第二N型轻掺杂多晶硅层(42、43)之间的未掺杂多晶硅层(44);步骤4、在所述栅极(60)、及栅极绝缘层(50)上沉积层间绝缘层(70),并在所述层间绝缘层(70)及栅极绝缘层(50)上形成对应于所述第一、第二N型重掺杂非晶硅层(31、32)上方的过孔(71),在所述层间绝缘层(70)上形成源/漏极(80),所述源/漏极(80)经由过孔(71)与所述第一、第二N型重掺杂非晶硅层(31、32)相接触;所述第一、第二N型重掺杂非晶硅层(31、32)、第一、第二N型轻掺杂多晶硅层(42、43)、及未掺杂多晶硅层(44)的厚度相同,从而构成一平坦层,使得在该平坦层上沉积的栅极绝缘层(50)的厚度均匀。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
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H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
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