[发明专利]一种用于可编程器件的降低时钟偏移的方法有效
| 申请号： | 201610098914.5 | 申请日： | 2016-02-23 |
| 公开（公告）号： | CN105786087B | 公开（公告）日： | 2018-08-03 |
| 发明（设计）人： | 谢长生;于宗光;单悦尔;匡晨光 | 申请（专利权）人： | 无锡中微亿芯有限公司 |
| 主分类号： | G06F1/10 | 分类号： | G06F1/10 |
| 代理公司： | 南京经纬专利商标代理有限公司 32200 | 代理人： | 朱小兵 |
| 地址： | 214000 江苏省*** | 国省代码： | 江苏;32 |
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| 摘要： | 本发明提出一种用于可编程器件的降低时钟偏移的方法，将芯片时钟分为第一时钟层次和若干个第二时钟层次，第一时钟层次和第二时钟层次均采用单向鱼骨型时钟走线，第一时钟层次为垂直时钟走线，第二时钟层次均为水平时钟走线，第一时钟层次与时钟源相连，第一时钟层次通过多路选择器MUX或时钟缓冲器与第二时钟层次相连，第二时钟层次的时钟通过时钟缓冲器与若干个时钟负载相连，通过时钟缓冲器的单元延迟的差异来补偿每级时钟层次的时钟偏移，从而降低时钟架构总的时钟偏移，实现芯片中各时钟负载处具有较小的时钟偏移。 | ||
| 搜索关键词： | 一种 用于 可编程 器件 降低 时钟 偏移 方法 | ||
【主权项】：
1.一种用于可编程器件的降低时钟偏移的方法，其特征在于，将芯片时钟分为第一时钟层次和若干个第二时钟层次，第一时钟层次和第二时钟层次均采用单向鱼骨型时钟走线，其中，第一时钟层次为垂直时钟走线，第二时钟层次均为水平时钟走线，第一时钟层次与时钟源相连，第一时钟层次通过多路选择器MUX或时钟缓冲器与第二时钟层次相连，第二时钟层次的时钟通过时钟缓冲器与若干个时钟负载相连，近时钟源端的时钟缓冲器的单元延迟比远时钟源端的时钟缓冲器的单元延迟大，时钟缓冲器之间的单元延迟差等于对应时钟之间的走线延迟。
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