[发明专利]触发器在审

专利信息
申请号: 201611037283.2 申请日: 2016-11-11
公开(公告)号: CN106998199A 公开(公告)日: 2017-08-01
发明(设计)人: 高章瑞;刘祈麟;鲁立忠;谢尚志;林柏廷 申请(专利权)人: 台湾积体电路制造股份有限公司
主分类号: H03K3/3562 分类号: H03K3/3562;G06F1/10
代理公司: 南京正联知识产权代理有限公司32243 代理人: 顾伯兴
地址: 中国台湾新竹科*** 国省代码: 台湾;71
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摘要: 一种触发器包括用以接收数据信号及扫描输入信号的主锁存器。所述主锁存器基于扫描使能信号向从锁存器提供数据信号或扫描输入信号中的一者。所述触发器包括用以基于输入时钟信号及所述扫描使能信号中的一者或两者而产生时钟信号的电路系统。第一时钟信号被提供至主锁存器且第二时钟信号被提供至从锁存器。当所述扫描使能信号具有第一逻辑电平时,所述第一时钟信号不包括与所述第二时钟信号的边沿跃迁同时发生的边沿跃迁。当所述扫描使能信号具有第二逻辑电平时,所述第一时钟信号包括与所述第二时钟信号的边沿跃迁同时发生的边沿跃迁。
搜索关键词: 触发器
【主权项】:
一种触发器,其特征在于,包括:主锁存器,用以接收数据信号及扫描输入信号;从锁存器,耦合至所述主锁存器,所述主锁存器基于由所述主锁存器接收的扫描使能信号向所述从锁存器选择性地提供所述数据信号或所述扫描输入信号中的一者;以及电路系统,用以接收所述扫描使能信号并基于输入时钟信号及所述扫描使能信号中的一者或两者而产生多个时钟信号,所述时钟信号包括(i)被提供至所述主锁存器的第一时钟信号,及(ii)被提供至所述从锁存器的第二时钟信号,其中当所述扫描使能信号具有第一逻辑电平时,所述第一时钟信号不包括与所述第二时钟信号的边沿跃迁同时发生的边沿跃迁,且其中当所述扫描使能信号具有不同于所述第一逻辑电平的第二逻辑电平时,所述第一时钟信号包括与所述第二时钟信号的边沿跃迁同时发生的边沿跃迁。
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