[实用新型]一种并行运算器及并行运算系统有效
申请号: | 201621053688.0 | 申请日: | 2016-09-13 |
公开(公告)号: | CN206162532U | 公开(公告)日: | 2017-05-10 |
发明(设计)人: | 曾杰;陈晓科;徐晓刚;张炳达;谢宁;张弛;李鑫;李兰芳;汪进锋;黄嘉健;黄杨珏;王潇;付绍文;王雪莹;周述前;韦玮;董星辰;张晓宇;许伯阳;黄森年 | 申请(专利权)人: | 广东电网有限责任公司电力科学研究院 |
主分类号: | G06F17/50 | 分类号: | G06F17/50;G06F7/57 |
代理公司: | 北京集佳知识产权代理有限公司11227 | 代理人: | 罗满 |
地址: | 510080 广东*** | 国省代码: | 广东;44 |
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摘要: | 本实用新型公开了一种并行运算器及并行运算系统,并行运算器包括除法器、第一乘法器、第二乘法器、第一加法器、第二加法器、第一选择器至第五选择器、第一数据输入口至第十数据输入口、第一数据输出口至第五数据输出口;并行运算系统包括多个并行运算器,且每两个并行运算器之间通过四口寄存器组共享的方式实现通讯连接。上述并行运算器,可以并行执行对应的加减乘除运算,大大提高了运算器的运算速度;上述并行运算系统,实现了不同并行运算器之间的数据共享,进而加大了数据传输流量;另外上述并行计算器在对外部数据进行读取及写入时可以利用对应数据存储器组采用乒乓操作的交互方法实现,保证了多速率硬件在环的实时仿真过程中的计算准确性。 | ||
搜索关键词: | 一种 并行 运算器 运算 系统 | ||
【主权项】:
一种并行运算器,其特征在于,包括除法器、第一乘法器、第二乘法器、第一加法器、第二加法器、第一选择器至第五选择器、第一数据输入口至第十数据输入口、第一数据输出口至第五数据输出口,其中:第四数据输入口及第五数据输入口与所述除法器的输入端连接,所述除法器的输出端分别与第一选择器、第二选择器及第一数据输出口连接;所述第一选择器的输入端与第六数据输入口连接,输出端及第七数据输入口均与第一乘法器连接,第一乘法器的输出端分别与第三选择器、第四选择器及第三数据输出口连接;第三选择器的输入端与第九数据输入口连接,输出端与第十数据输入口均与第一加法器的输入端连接,第一加法器的输出端与第五数据输出口连接;第四选择器的输入端与第八数据输入口连接,输出端与第五选择器的输出端均与第二加法器的输入端连接,第二加法器的输出端与第四数据输出口连接;第二选择器的输入端与第三数据输入口连接,输出端与第二数据输入口均与第二乘法器的输入端连接,第二乘法器的输出端与第二数据输出口连接的同时与第一数据输入口均与第五选择器的输入端连接。
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