[实用新型]异构多核处理器功耗控制装置和异构多核处理器系统有效
| 申请号： | 201621142931.6 | 申请日： | 2016-10-20 |
| 公开（公告）号： | CN206162380U | 公开（公告）日： | 2017-05-10 |
| 发明（设计）人： | 蔡田田;习伟;姚浩;陈波;郭晓斌;李鹏;杨祎巍;陈浩敏;蒋愈勇;王建邦 | 申请（专利权）人： | 南方电网科学研究院有限责任公司 |
| 主分类号： | G06F1/32 | 分类号： | G06F1/32;G06F15/16 |
| 代理公司： | 广州华进联合专利商标代理有限公司44224 | 代理人： | 黄晓庆 |
| 地址： | 510080 广东*** | 国省代码： | 广东;44 |
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| 摘要： | 本实用新型涉及一种异构多核处理器功耗控制装置和异构多核处理器系统，其异构多核处理器功耗控制装置包括与n个CPU均连接的时钟管理单元，还包括与所述时钟管理单元连接的m个电源接口以及w个门控时钟模块，其中，n和m均为大于1的整数，w为n和m的和值；各所述电源接口还分别连接一个IP，各所述门控时钟模块还分别连接一个所述CPU或者一个所述IP，所述IP的总数量为m；采用本实用新型的方案，可以降低芯片功耗，还可以单独关闭各个IP的时钟和电源。 | ||
| 搜索关键词： | 多核 处理器 功耗 控制 装置 系统 | ||
【主权项】：
一种异构多核处理器功耗控制装置，其特征在于，包括与n个CPU均连接的时钟管理单元，还包括与所述时钟管理单元连接的m个电源接口以及w个门控时钟模块，其中，n和m均为大于1的整数，w为n和m的和值；各所述电源接口还分别连接一个IP，各所述门控时钟模块还分别连接一个所述CPU或者一个所述IP，所述IP的总数量为m。
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