[发明专利]pFET区域中的应变释放在审
申请号: | 201680005565.6 | 申请日: | 2016-01-04 |
公开(公告)号: | CN107210225A | 公开(公告)日: | 2017-09-26 |
发明(设计)人: | B·多里斯;K·里姆;A·雷茨尼采克;D·D·鲁;A·卡基菲鲁兹;程慷果 | 申请(专利权)人: | 国际商业机器公司 |
主分类号: | H01L21/336 | 分类号: | H01L21/336;H01L29/78 |
代理公司: | 北京市中咨律师事务所11247 | 代理人: | 贺月娇,于静 |
地址: | 美国*** | 国省代码: | 暂无信息 |
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摘要: | 一种用于制造半导体器件的方法包括提供绝缘体上应变硅(SSOI)结构,该SSOI结构包括设置在衬底(10)上的电介质层(20)、设置在电介质层(20)上的硅锗层(30)、以及直接设置在硅锗层(30)上的应变半导体材料层(40);在SSOI结构上形成多个鳍(43、45);在nFET区域中的至少一个鳍的部分之上形成栅极结构(50);在pFET区域中的至少一个鳍的部分之上形成栅极结构(60);去除pFET区域中的至少一个鳍的部分之上的栅极结构(60);去除通过上述去除而被暴露的硅锗层(30);以及在pFET区域中的至少一个鳍的部分之上形成新的栅极结构(90),以使得新的栅极结构(90)在全部四侧包围该部分。 | ||
搜索关键词: | pfet 区域 中的 应变 释放 | ||
【主权项】:
一种用于制造半导体器件的方法,包括:提供绝缘体上应变硅(SSOI)结构,其中所述SSOI结构至少包括衬底、设置在所述衬底上的电介质层、设置在所述电介质层上的硅锗层、以及直接设置在所述硅锗层上的应变半导体材料层;通过将所述应变半导体材料层和所述硅锗层向下蚀刻到所述电介质层而在所述SSOI结构上形成多个鳍,其中所述多个鳍中的至少一个鳍位于所述SSOI结构的nFET区域中,并且所述多个鳍中的至少一个鳍位于所述SSOI结构的pFET区域中;在所述多个鳍中的位于所述nFET区域中的所述至少一个鳍的第一部分之上形成第一栅极结构;在所述多个鳍中的位于所述pFET区域中的所述至少一个鳍的第二部分之上形成第二栅极结构,以使得所述第二栅极结构在三侧包围所述第二部分;去除所述多个鳍中的位于所述pFET区域中的所述至少一个鳍的所述第二部分之上的所述第二栅极结构;去除通过去除所述第二部分之上的所述第二栅极结构而被暴露的所述硅锗层;以及在所述多个鳍中的位于所述pFET区域中的所述至少一个鳍的所述第二部分之上形成第三栅极结构,以使得所述第三栅极结构在全部四侧包围所述第二部分。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
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H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
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H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
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