[发明专利]数据处理装置有效

专利信息
申请号: 201680019602.9 申请日: 2016-04-06
公开(公告)号: CN107408076B 公开(公告)日: 2020-12-11
发明(设计)人: 中岛康彦;高前田伸也 申请(专利权)人: 国立大学法人奈良先端科学技术大学院大学
主分类号: G06F9/38 分类号: G06F9/38;G06F12/0895;G06F9/30;G06F12/0864;G06F12/0811;G06F12/0842;G06F15/80
代理公司: 深圳市智胜联合知识产权代理有限公司 44368 代理人: 李永华;齐文剑
地址: 日本奈良县*** 国省代码: 暂无信息
权利要求书: 查看更多 说明书: 查看更多
摘要: 发明的数据处理装置具有二维结构,该二维结构通过将包括具有多个接口的内存模块(606)、内存模块(606)的各接口的地址生成器(604)以及运算器(603)的基本单元(600)在水平方向上配列成多个way,并将水平方向上排列有多个way的阶段在垂直方向上排列成多个而形成。
搜索关键词: 数据处理 装置
【主权项】:
一种数据处理装置,其具有一二维结构,该二维结构通过把水平方向上排列有多个way的阶段在垂直方向上排列成多个而形成,每一个way包括多个基本单元,各基本单元包括具有多个接口(port)的内存模块、所述内存模块的各接口的地址生成器以及运算器,各所述基本单元进一步包括数据总线、演算总线和开关群、以及内存总线和开关群,所述数据总线从属于同一阶段的所述内存模块中同时读取多个way×多个文字,所述演算总线和开关群将所述多个文字同时提供给同一阶段的所述运算器,所述内存总线和开关群将所述运算器的输出写入属于同一阶段的所述内存模块;属于同一way的所述内存模块所使用的写入总线和读取总线通过相同的总线连接到外部存储器,同时进行从外部存储器向所述内存模块的写入和从所述内存模块向所述运算器的读取,并且,同时进行从所述运算器到所述内存模块的写入和从所述内存模块向所述外部存储器的读取;通过所述地址生成器读取所述内存模块时,同时读取多个文字,同时将值写入所述基本单元的末端寄存器。
下载完整专利技术内容需要扣除积分,VIP会员可以免费下载。

该专利技术资料仅供研究查看技术是否侵权等信息,商用须获得专利权人授权。该专利全部权利属于国立大学法人奈良先端科学技术大学院大学,未经国立大学法人奈良先端科学技术大学院大学许可,擅自商用是侵权行为。如果您想购买此专利、获得商业授权和技术合作,请联系【客服

本文链接:http://www.vipzhuanli.com/patent/201680019602.9/,转载请声明来源钻瓜专利网。

×

专利文献下载

说明:

1、专利原文基于中国国家知识产权局专利说明书;

2、支持发明专利 、实用新型专利、外观设计专利(升级中);

3、专利数据每周两次同步更新,支持Adobe PDF格式;

4、内容包括专利技术的结构示意图流程工艺图技术构造图

5、已全新升级为极速版,下载速度显著提升!欢迎使用!

请您登陆后,进行下载,点击【登陆】 【注册】

关于我们 寻求报道 投稿须知 广告合作 版权声明 网站地图 友情链接 企业标识 联系我们

钻瓜专利网在线咨询

周一至周五 9:00-18:00

咨询在线客服咨询在线客服
tel code back_top