[发明专利]用于指派集成电路布局中的群约束的系统和方法有效

专利信息
申请号: 201680048271.1 申请日: 2016-07-01
公开(公告)号: CN107924135B 公开(公告)日: 2019-08-20
发明(设计)人: L·李维利-卡佐 申请(专利权)人: 高通股份有限公司
主分类号: G03F7/20 分类号: G03F7/20;G06F17/50
代理公司: 上海专利商标事务所有限公司 31100 代理人: 杨丽;李小芳
地址: 美国加利*** 国省代码: 美国;US
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摘要: 提供了用于配置单元的各特征的群约束以用于多重图案化工艺的方法和装置。该装置确定:电路布局内的各特征,对这些特征中的至少一者的距离约束,基于这些距离约束对各特征的群约束,这些群约束定义了对这些特征中的每一者所可指派的群的限制。另外,该装置接收包括多个邻接单元的集成电路布局。该装置接着确定第二单元的群约束是否与第一单元的群约束相冲突,第二单元与第一单元邻接;并且基于第一单元的群约束以及基于与第一单元的群约束相冲突的第二单元的群约束来配置第二单元的群约束的子集。
搜索关键词: 用于 指派 集成电路 布局 中的 约束 系统 方法
【主权项】:
1.一种将群约束指派到电路布局中的特征以用于多重图案化工艺的方法,包括:确定所述电路布局内的特征;确定对所述特征中的至少一个特征的距离约束;基于所述距离约束来确定对所述特征的群约束,所述群约束定义对所述特征中的每一特征所能够指派的群的限制;以及将所述群约束指派到所述特征。
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