[发明专利]用于维特比解码器的高速加比选在审
申请号: | 201680078515.0 | 申请日: | 2016-12-07 |
公开(公告)号: | CN108702162A | 公开(公告)日: | 2018-10-23 |
发明(设计)人: | Y·阿藏科;B·蔡德尔 | 申请(专利权)人: | MACOM连接解决有限公司 |
主分类号: | H03M13/41 | 分类号: | H03M13/41;H03M13/00 |
代理公司: | 北京市磐华律师事务所 11336 | 代理人: | 高伟;娄晓丹 |
地址: | 美国加利*** | 国省代码: | 美国;US |
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摘要: | 一种用于高速维特比解码的比选状态度量值的系统和方法。在加比选(ACS)单元中,通过对比较器决策信号执行布尔操作来产生选择控制信号,并且其用于控制多工器结构。比较器决策信号可以由比较器阵列比较所有可能的状态度量值集合对来并行生成。布尔操作是通过布尔代数预定义的,布尔代数使用决策信号作为变量,并且服从选择标准所施加的限制,例如,选择状态度量值集合的最小值或最大值。布尔操作是由使用基本逻辑门(例如AND,OR或NOT)实现的逻辑模块执行的。结果是,接收输入值集合的多工器结构能够响应于选择控制信号而输出最优值。 | ||
搜索关键词: | 布尔操作 决策信号 选择控制信号 度量值集合 布尔代数 比较器 多工器 维特比解码器 比较器阵列 高速维特比 基本逻辑门 解码 接收输入 逻辑模块 选择标准 选择状态 预定义 并行 集合 施加 输出 响应 | ||
【主权项】:
1.一种从以维特比解码的多个状态度量值中选择状态度量值的方法,所述方法包括:成对地比较所述多个状态度量值,以产生多个第一决策信号,其中各个第一决策信号指示来自相应的状态度量值对的所选状态度量值;通过对所述多个第一决策信号执行布尔操作来生成第一选择信号;以及基于所述第一选择信号,从所述多个状态度量值中选择结果状态度量值。
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